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參數(shù)資料
| 型號： | CY39200V388-125MGC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | CPLDs at FPGA Densities |
| 中文描述： | LOADABLE PLD, 10 ns, PBGA388 |
| 封裝： | 35 X 35 MM, 1.27 MM PITCH, BGA-388 |
| 文件頁數(shù)： | 28/86頁 |
| 文件大?。?/td> | 1212K |
| 代理商： | CY39200V388-125MGC |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 28 of 86
Switching Waveforms
(continued)
Cluster Memory Synchronous Flow-Through Timing
GLOBAL
CLOCK
ADDRESS
WRITE
ENABLE
REGISTERED
INPUT
REGISTERED
OUTPUT
t
CLMS
t
CLMS
t
CLMS
t
CLMH
t
CLMH
t
CLMH
READ
WRITE
READ
t
CLMDV1
t
CLMDV1
t
CLMDV1
t
CLMCYC1
Cluster Memory Internal Clocking
MACROCELL
INPUT CLOCK
CLUSTER MEMORY
INPUT CLOCK
CLUSTER MEMORY
OUTPUT CLOCK
t
CLMMACS2
t
MACCLMS2
t
CLMMACS1
t
MACCLMS1
相關PDF資料 |
PDF描述 |
|---|---|
| CY39165V676-125BBC | CPLDs at FPGA Densities |
| CY39165V676-125BBI | CPLDs at FPGA Densities |
| CY39165V676-125BGC | CPLDs at FPGA Densities |
| CY39165V676-125BGI | CPLDs at FPGA Densities |
| CY39165V676-125MBC | CPLDs at FPGA Densities |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| CY39200V388-181MGC | 制造商:Cypress Semiconductor 功能描述: |
| CY39200V388-181NC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200V388-233MGC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200V388-233MGI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200V388-233NTC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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