參數(shù)資料
型號(hào)： CY39165Z676-125MBC
廠(chǎng)商： CYPRESS SEMICONDUCTOR CORP
元件分類(lèi)： PLD
英文描述： CPLDs at FPGA Densities
中文描述： LOADABLE PLD, 10 ns, PBGA676
封裝： 27 X 27 MM, 1.60 MM HEIGHT, 1 MM PITCH, FBGA-676
文件頁(yè)數(shù)： 30/86頁(yè)
文件大?。?/td> 1212K
代理商： CY39165Z676-125MBC
Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 30 of 86
Switching Waveforms
(continued)
Channel Memory DP Asynchronous Timing
WRITE
ENABLE
t
CHMPWE
t
CHMSA
t
CHMHA
t
CHMAA
t
CHMHD
ADDRESS
DATA
INPUT
OUTPUT
t
CHMAA
A
n-1
A
n
A
n+1
A
n+2
D
n
D
n–1
D
n
D
n+1
t
CHMSD
Channel Memory Internal Clocking
CLOCK
INPUT CLOCK
OUTPUT CLOCK
t
CHMMACS1
t
MACCHMS2
t
CHMMACS2
t
MACCHMS1
MACROCELL INPUT
CHANNEL MEMORY
CHANNEL MEMORY
相關(guān)PDF資料
PDF描述
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CY3950Z676-125MBI CPLDs at FPGA Densities
CY39100Z676-125MBI CPLDs at FPGA Densities
CY39165Z676-125MBI CPLDs at FPGA Densities
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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