參數(shù)資料
型號(hào)： CY29977
英文描述： Clocks and Buffers
中文描述： 時(shí)鐘和緩沖器
文件頁(yè)數(shù)： 2/7頁(yè)
文件大?。?/td> 193K
代理商： CY29977
CY29940-1
Document #: 38-07487 Rev. **
Page 2 of 7
Note:
1.
PD = Internal Pull-down; PU = Internal Pull-up.
Pin Description
[1]
Pin
Name
PWR
I/O
I, PU
PECL Input Clock
I, PD
PECL Input Clock
I, PD
External Reference/Test Clock Input
O
Clock Outputs
Description
5
6
3
9, 10, 11, 13,
14, 15, 18, 19,
20, 22, 23, 24,
26, 27, 28, 30,
31, 32
4
PECL_CLK
PECL_CLK#
TCLK
Q(17:0)
VDDC
TCLK_SEL
I, PD
Clock Select Input
. When LOW, PECL clock is selected and when HIGH
TCLK is selected.
3.3V or 2.5V Power Supply for Output Clock Buffers
3.3V or 2.5V Power Supply
Common Ground
8, 16, 29
7, 21
1, 2, 12, 17, 25 VSS
VDDC
VDD
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PDF描述
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CY29FCT520BTLM Pipeline Register
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