參數(shù)資料
型號: CDP1883E
廠商: INTERSIL CORP
元件分類: 通用總線功能
英文描述: CMOS 7-Bit Latch and Decoder Memory Interfaces
中文描述: HIGH LEVEL TRIGGERED D LATCH, TRUE OUTPUT, PDIP20
封裝: PLASTIC, DIP-20
文件頁數(shù): 6/6頁
文件大?。?/td> 32K
代理商: CDP1883E
4-134
FIGURE 2. MINIMUM CDP1800-SYSTEM USING THE CDP1883 INTERFACE WITH AN 8K X 8-BIT MEMORY
FIGURE 3. 32K-BYTE ROM SYSTEM USING THE CDP1883
CDP1883
LATCH/
DECODER
A0 - A6
CLK
CS0
CS1
CS2
CS3
WE
CE
A0 - A7
CDM6264
8K x 8
RAM
CE
CDP1837C
4K x 8
ROM
TPA
A0 - A7
MRD
CEO
TPA
MRD
MWR
CDP1800
SERIES
CPU
WAIT
CLR
A8 - A12
ADDRESS BUS
DATA BUS
OE
CDP1883
LATCH/
DECODER
CS3
CS2
CS1
CS0
CLK
CE
MA0 - MA6
A8 - A12
WAIT
CLR
TPA
MRD
CDP1800
SERIES
CPU
CDM5364
8K x 8
ROM
A0 - A7
CE
A8 - A12
CDM5364
8K x 8
ROM
A8 - A12
CE
A0 - A7
CDM5364
8K x 8
ROM
A8 - A12
CE
A0 - A7
CDM5364
8K x 8
ROM
A8 - A12
CE
A0 - A7
ADDRESS BUS
ADDRESS BUS
DATA BUS
CDP1883, CDP1883C
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