參數(shù)資料
型號(hào)： CDP1883E
廠商： INTERSIL CORP
元件分類： 通用總線功能
英文描述： CMOS 7-Bit Latch and Decoder Memory Interfaces
中文描述： HIGH LEVEL TRIGGERED D LATCH, TRUE OUTPUT, PDIP20
封裝： PLASTIC, DIP-20
文件頁(yè)數(shù)： 3/6頁(yè)
文件大?。?/td> 32K
代理商： CDP1883E
4-131
Functional Diagram
Minimum Data
Retention Voltage
V
DR
V
DD
= V
DR
-
2
2.4
-
2
2.4
V
Data Retention Current
I
DR
V
DD
= 2.4V
-
0.01
1
-
0.5
5
μ
A
Input Capacitance
C
IN
-
-
-
-
5
7.5
-
5
7.5
pF
Output Capacitance
C
OUT
-
-
-
-
10
15
-
10
15
pF
NOTES:
1. Typical values are for T
A
= +25
o
C.
2. I
OL
= I
OH
=
μ
A
3. Operating current measured at 200kHz for V
DD
= 5V and 400kHz for V
DD
= 10V, with outputs open circuit.
Static Electrical Specifications
At T
A
= -40
o
C to +85
o
C, V
DD
±
5
%,
Except as Noted:
(Continued)
PARAMETER
SYMBOL
CONDITIONS
CDP1883
CDP1883C
UNITS
V
O
(V)
V
IN
(V)
V
DD
(V)
MIN
(NOTE 1)
TYP
MAX
MIN
(NOTE 1)
TYP
MAX
2
3
4
5
6
7
8
1
20
10
9
11
12
13
14
17
16
15
18
19
D
C
Q
D
C
Q
D
C
Q
D
C
Q
D
C
Q
Q
D
C
Q
D
C
Q
Q
MA0
MA1
MA2
MA3
MA4
MA5
MA6
CLOCK
CE
A8
A9
A10
A11
A12
CS0
CS1
CS2
CS3
V
DD
=
V
SS
=
CDP1883, CDP1883C
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PDF描述
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