Configuration Register Descriptions D23(MSB) D22 D21 D20 D19 D18 D17 D16 D15 D14 D13 D12 A1 A0 D3 D2 D1 D0 NU LPM WR2 WR1 WR0" />
參數(shù)資料
型號： CDB5529
廠商： Cirrus Logic Inc
文件頁數(shù)： 13/31頁
文件大小： 0K
描述： EVAL BOARD FOR CS5529
標(biāo)準(zhǔn)包裝： 1
ADC 的數(shù)量： 1
位數(shù)： 16
采樣率（每秒）： 303
數(shù)據(jù)接口： 串行
輸入范圍： ±2.5 V
在以下條件下的電源（標(biāo)準(zhǔn)）： 2.6mW @ 2.5V
工作溫度： -40°C ~ 85°C
已用 IC / 零件： CS5529
已供物品： 板，線纜，磁盤
產(chǎn)品目錄頁面： 755 (CN2011-ZH PDF)
相關(guān)產(chǎn)品： CS5529-ASZR-ND - IC ADC 16BIT W/6BIT LATCH 20SSOP
598-1110-5-ND - IC ADC 16BIT W/6BIT LATCH 20SSOP
其它名稱： 598-1015
CS5529
20
DS246F5
Configuration Register Descriptions
D23(MSB)
D22
D21
D20
D19
D18
D17
D16
D15
D14
D13
D12
A1
A0
D3
D2
D1
D0
NU
LPM
WR2
WR1
WR0
U/B
D11
D10
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
NU
RS
RV
PF
PSS
DF
CC2
CC1
CC0
BIT
NAME
VALUE
FUNCTION
D23-D22 Latch Outputs, A1-A0
00
R* Latch Output Pins A1-A0 mimic the D23-D22 Register bits.
D21-D18 Latch Outputs, D3-D0
0000
R* Latch Output Pins D3-D0 mimic the D21-D18 Register bits.
D17
Not Used, NU
0
R Must always be logic zero.
D16
Low Power Mode,
LPM
0
1
R Normal Mode (
2.5 mW)
Reduced Power Mode (
1 mW)
D15-D13 Word Rate, WR2-0
(Note: Rates valid for
XIN = 32.768 kHz)
000
001
010
011
100
101
110
111
R 15.0 Sps (2180 XIN cycles)
30.0 Sps (1092 XIN cycles)
61.6 Sps (532 XIN cycles)
84.5 Sps (388 XIN cycles)
101.1 Sps (324 XIN cycles)
1.88 Sps (17444 XIN cycles)
3.76 Sps (8724 XIN cycles)
7.51 Sps (4364 XIN cycles)
D12
Unipolar/Bipolar, U/B
0
1
R Bipolar Measurement mode
Unipolar Measurement mode
D11-D8
Not Used, NU
0
R Must always be logic 0.
D7
Reset System, RS
0
1
R Normal Operation
Activate a Reset cycle. To return to normal operation this bit must
be written back to logic zero.
D6
Reset Valid , RV
0
1R
No reset has occurred or bit has been cleared (read only).
Valid Reset has occurred. (Cleared when read.)
D5
Port Flag, PF
0
1
R Port Flag mode inactive
Port Flag mode active
D4
Power Save Select,
PSS
0
1
R Standby Mode (Oscillator active, allows quick power-up)
Sleep Mode (Oscillator inactive)
D3
Done Flag, DF
0
1
R Done Flag bit is cleared (read only).
Calibration or Conversion cycle completed (read only).
D2-D0
Calibration Control
Bits, CC2-CC0
000
001
010
011
100
101
110
111
R Normal operation (no calibration)
Offset -- Self-Calibration
Gain -- Self-Calibration
Offset self-cal followed by Gain self-calibration
Not Used.
Offset -- System Calibration
Gain -- System Calibration
Not Used.
* R indicates the bit value after the part is reset
相關(guān)PDF資料
PDF描述
VE-J1F-EY CONVERTER MOD DC/DC 72V 50W
GCM22DSXH CONN EDGECARD 44POS DIP .156 SLD
CDB5368 BOARD EVAL FOR CS5368 192KHZ ADC
VE-J1B-EY CONVERTER MOD DC/DC 95V 50W
VE-J14-EY CONVERTER MOD DC/DC 48V 50W
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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CDB5534U 功能描述:數(shù)據(jù)轉(zhuǎn)換 IC 開發(fā)工具 Eval Bd 24Bit ADC w/ Ultra Low-Noise USB RoHS:否 制造商:Texas Instruments 產(chǎn)品:Demonstration Kits 類型:ADC 工具用于評估:ADS130E08 接口類型:SPI 工作電源電壓:- 6 V to + 6 V
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CDB5540 制造商:Cirrus Logic 功能描述:EVAL BOARD FOR CS5540 - Bulk
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