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參數(shù)資料
| 型號(hào)： | CA3054MZ96 |
| 廠商： | Intersil |
| 文件頁數(shù)： | 4/8頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC OP AMP 2X DIFF 14-SOIC |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 放大器類型： | 差分 |
| 電路數(shù)： | 2 |
| 增益帶寬積： | 550MHz |
| 電流 - 輸入偏壓： | 10µA |
| 電壓 - 輸入偏移： | 450µV |
| 工作溫度： | 0°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 14-SOIC（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 14-SOIC |
| 包裝： | 帶卷 (TR) |
4
Admittance Characteristics; Cascode Circuit Con-
figuration (For Each Amplifier)
Forward Transfer Admittance (Figure 19)
Y21
VCB = 3V, f = 1MHz
Total Stage IC ≈ 2.5 mA
-
68 - j0
-
mS
Input Admittance (Figure 20)
Y11
VCB = 3V, f = 1MHz
Total Stage IC ≈ 2.5 mA
-
0.55 +
j0
-mS
Output Admittance (Figure 21)
Y22
VCB = 3V, f = 1MHz
Total Stage IC ≈ 2.5 mA
-0 +
j0.02
-mS
Reverse Transfer Admittance (Figure 22)
Y12
VCB = 3V, f = 1MHz
Total Stage IC ≈ 2.5 mA
-
0.004 -
j0.005
-
S
Noise Figure
NF
f = 100MHz
-
8
-
dB
Electrical Specifications TA = 25°C (Continued)
PARAMETER
SYMBOL
TEST CONDITIONS
MIN
TYP
MAX
UNIT
Test Circuits
FIGURE 1. COMMON MODE REJECTION RATIO TEST SETUP
FIGURE 2. SINGLE STAGE VOLTAGE GAIN TEST SETUP
FIGURE 3. TWO STAGE VOLTAGE GAIN TEST SETUP
ICUT
11
7
9
6
12
8
SIGNAL
SOURCE
10
F
VIN = 0.3VRMS
0.5k
1k
0.5k
0.1
F
1k
VOUT
0.1
F
VCC = +12V
VX
VCC = +12V
VEE = -6V
ICUT
11
7
9
6
12
8
SIGNAL
SOURCE
10
F
VIN = 10mVRMS
1k
1k
0.5k
0.1
F
VEE = -6V
VCC = +12V
1k
VOUT
0.1
F
VX
1k
VCC = +12V
ICUT
9
6
13
8
SIGNAL
SOURCE
10
F
VIN = 1mVRMS
1k
1k
VCC = +12V
VOUT
1k
14
12
1k
1k
1
F
3
11
2
7
1
4
1
F
1k
1k
0.5k
0.5k
1k
VEE = -6V
0.1
F
VCC = +12V
VX
0.1
F
CA3054
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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