參數資料
型號： C8051T630DK
廠商： Silicon Laboratories Inc
文件頁數： 85/220頁
文件大?。?/td> 0K
描述： KIT DEV FOR C8051T630 FAMILY
標準包裝： 1
類型： MCU
適用于相關產品： C8051T630、T631、T632、T633、T634 和 T635 MCU
所含物品： 板，子板，電源適配器，線纜，說明文檔和軟件
產品目錄頁面： 626 (CN2011-ZH PDF)
配用： 336-1465-ND - BOARD SOCKET DAUGHTER 20-QFN
相關產品： 336-1463-5-ND - IC MCU 2KB 20PIN QFN
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336-1459-5-ND - IC MCU 8KB 20PIN QFN
336-1458-5-ND - IC MCU 8KB 20PIN QFN
其它名稱： 336-1464
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Rev. 1.0
175
C8051T630/1/2/3/4/5
SFR Address = 0x88; Bit-Addressable
SFR Definition 24.2. TCON: Timer Control
Bit
76543210
Name
TF1
TR1
TF0
TR0
IE1
IT1
IE0
IT0
Type
R/W
Reset
00000000
Bit
Name
Function
7
TF1
Timer 1 Overflow Flag.
Set to 1 by hardware when Timer 1 overflows. This flag can be cleared by software
but is automatically cleared when the CPU vectors to the Timer 1 interrupt service
routine.
6TR1
Timer 1 Run Control.
Timer 1 is enabled by setting this bit to 1.
5
TF0
Timer 0 Overflow Flag.
Set to 1 by hardware when Timer 0 overflows. This flag can be cleared by software
but is automatically cleared when the CPU vectors to the Timer 0 interrupt service
routine.
4TR0
Timer 0 Run Control.
Timer 0 is enabled by setting this bit to 1.
3IE1
External Interrupt 1.
This flag is set by hardware when an edge/level of type defined by IT1 is detected. It
can be cleared by software but is automatically cleared when the CPU vectors to the
External Interrupt 1 service routine in edge-triggered mode.
2IT1
Interrupt 1 Type Select.
This bit selects whether the configured /INT1 interrupt will be edge or level sensitive.
/INT1 is configured active low or high by the IN1PL bit in the IT01CF register (see
0: /INT1 is level triggered.
1: /INT1 is edge triggered.
1IE0
External Interrupt 0.
This flag is set by hardware when an edge/level of type defined by IT1 is detected. It
can be cleared by software but is automatically cleared when the CPU vectors to the
External Interrupt 0 service routine in edge-triggered mode.
0IT0
Interrupt 0 Type Select.
This bit selects whether the configured INT0 interrupt will be edge or level sensitive.
INT0 is configured active low or high by the IN0PL bit in register IT01CF (see SFR
0: INT0 is level triggered.
1: INT0 is edge triggered.
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PDF描述
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參數描述
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