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參數(shù)資料
| 型號： | C8051F931-GM |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 126/330頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC 8051 MCU 64K FLASH 24-QFN |
| 產(chǎn)品培訓(xùn)模塊： | C8051F9xx Lower Power MCUs Serial Communication Overview |
| 視頻文件： | Designing for Low Power Operation |
| 特色產(chǎn)品： | C8051F91x/0x MCU Series Development Kit |
| 標(biāo)準(zhǔn)包裝： | 91 |
| 系列： | C8051F9xx |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 25MHz |
| 連通性： | SMBus（2 線/I²C），SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，POR，PWM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 16 |
| 程序存儲器容量： | 64KB（64K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 4.25K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 0.9 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 15x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 24-WFQFN 裸露焊盤 |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 625 (CN2011-ZH PDF) |
| 配用： | 336-1479-ND - PLATFORM PROG TOOLSTCK F921,F931 336-1476-ND - DAUGHTER CARD CAP TOUCH SENSE 336-1475-ND - KIT STARTER CAP TOUCH SENSE 336-1474-ND - DAUGHTER CARD TOOLSTCK C8051F931 336-1473-ND - KIT DEV C8051F920,F921,F930,F931 |
| 其它名稱： | 336-1468 |
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Rev. 1.4
211
C8051F93x-C8051F92x
20.3.2. Setting a SmaRTClock Alarm
The SmaRTClock alarm function compares the 32-bit value of SmaRTClock Timer to the value of the
ALARMn registers. An alarm event is triggered if the SmaRTClock timer is equal to the ALARMn registers.
If Auto Reset is enabled, the 32-bit timer will be cleared to zero one SmaRTClock cycle after the alarm
event.
The SmaRTClock alarm event can be configured to reset the MCU, wake it up from a low power mode, or
generate an interrupt. See Section “12. Interrupt Handler” on page 136, Section “14. Power Management”
on page 159, and Section “18. Reset Sources” on page 184 for more information.
The following steps can be used to set up a SmaRTClock Alarm:
1. Disable SmaRTClock Alarm Events (RTC0AEN = 0).
2. Set the ALARMn registers to the desired value.
3. Enable SmaRTClock Alarm Events (RTC0AEN = 1).
Notes:
The ALRM bit, which is used as the SmaRTClock Alarm Event flag, is cleared by disabling SmaRT-
Clock Alarm Events (RTC0AEN = 0).
If AutoReset is disabled, disabling (RTC0AEN = 0) then Re-enabling Alarm Events (RTC0AEN = 1)
after a SmaRTClock Alarm without modifying ALARMn registers will automatically schedule the next
alarm after 2^32 SmaRTClock cycles (approximately 36 hours using a 32.768 kHz crystal).
The SmaRTClock Alarm Event flag will remain asserted for a maximum of one SmaRTClock cycle.
See Section “14. Power Management” on page 159 for information on how to capture a SmaRTClock
Alarm event using a flag which is not automatically cleared by hardware.
20.3.3. Software Considerations for using the SmaRTClock Timer and Alarm
The SmaRTClock timer and alarm have two operating modes to suit varying applications. The two modes
are described below:
Mode 1
:
The first mode uses the SmaRTClock timer as a perpetual timebase which is never reset to zero. Every 36
hours, the timer is allowed to overflow without being stopped or disrupted. The alarm interval is software
managed and is added to the ALRMn registers by software after each alarm. This allows the alarm match
value to always stay ahead of the timer by one software managed interval. If software uses 32-bit unsigned
addition to increment the alarm match value, then it does not need to handle overflows since both the timer
and the alarm match value will overflow in the same manner.
This mode is ideal for applications which have a long alarm interval (e.g. 24 or 36 hours) and/or have a
need for a perpetual timebase. An example of an application that needs a perpetual timebase is one
whose wake-up interval is constantly changing. For these applications, software can keep track of the
number of timer overflows in a 16-bit variable, extending the 32-bit (36 hour) timer to a 48-bit (272 year)
perpetual timebase.
Mode 2
:
The second mode uses the SmaRTClock timer as a general purpose up counter which is auto reset to zero
by hardware after each alarm. The alarm interval is managed by hardware and stored in the ALRMn
registers. Software only needs to set the alarm interval once during device initialization. After each alarm,
software should keep a count of the number of alarms that have occurred in order to keep track of time.
This mode is ideal for applications that require minimal software intervention and/or have a fixed alarm
interval. This mode is the most power efficient since it requires less CPU time per alarm.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| P87LPC762FD,512 | IC 80C51 MCU 2K OTP 20-SOIC |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| C8051F931-GMR | 功能描述:8位微控制器 -MCU 64KB 10ADC MCU LEAD FREE RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
| C8051F93X | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Single/Dual Battery, 0.9–3.6 V, 64/32 kB, smaRTClock, 10-Bit ADC MCU |
| C8051F960-A-DK | 功能描述:開發(fā)板和工具包 - 8051 C8051F96X Development Kit RoHS:否 制造商:Silicon Labs 產(chǎn)品:Development Kits 工具用于評估:C8051F960, Si7005 核心: 接口類型:USB 工作電源電壓: |
| C8051F960-A-GM | 功能描述:8位微控制器 -MCU 128KB, DC-DC, LCD AES, DQFN76 RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
| C8051F960-A-GMR | 制造商:Silicon Laboratories Inc 功能描述:128KB, DC-DC, LCD, AES, DQFN76 - Tape and Reel 制造商:Silicon Laboratories Inc 功能描述:IC MCU 128KB DC-DC LCDAES 76DQFN |
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