參數(shù)資料
型號： BUK9618-56
廠商： NXP Semiconductors N.V.
英文描述： TrenchMOS（TM）transistor Logic level FET(TrenchMOS（TM）晶體管邏輯電平FET)
中文描述： TrenchMOS（商標）場效應(yīng)晶體管邏輯電平（TrenchMOS（商標）晶體管邏輯電平場效應(yīng)管）
文件頁數(shù)： 5/8頁
文件大小： 68K
代理商： BUK9618-56
Philips Semiconductors
Product specification
TrenchMOS
transistor
Logic level FET
BUK9618-55
Fig.11. Sub-threshold drain current.
I
D
= f(V
GS)
; conditions: T
j
= 25 C; V
DS
= V
GS
Fig.12. Typical capacitances, C
, C
, C
.
C = f(V
DS
); conditions: V
GS
= 0 V; f = 1 MHz
Fig.13. Typical turn-on gate-charge characteristics.
V
GS
= f(Q
G
); conditions: I
D
= 50 A; parameter V
DS
Fig.14. Typical reverse diode current.
I
F
= f(V
SDS
); conditions: V
GS
= 0 V; parameter T
j
Fig.15. Normalised avalanche energy rating.
W
DSS
% = f(T
mb
); conditions: I
D
= 75 A
Fig.16. Avalanche energy test circuit.
W
DSS
=
0.5
LI
D
0
0.5
1
1.5
2
2.5
3
1E-05
1E-05
1E-04
1E-03
1E-02
1E-01
Sub-Threshold Conduction
2%
typ
98%
0
0.5
1
1.5
0
20
40
60
80
100
IF/A
VSDS/V
Tj/C =
175
25
0.01
0.1
1
10
100
0
1
2
3
4
5
VDS/V
T
Ciss
Coss
Crss
20
40
60
80
100
Tmb / C
120
140
160
180
120
110
100
90
80
70
60
50
40
30
20
10
0
WDSS%
0
5
10
15
20
25
30
35
40
0
1
2
3
4
5
6
VGS/V
QG/nC
VDS = 14V
VDS = 44V
L
T.U.T.
VDD
RGS
R 01
shunt
VDS
-ID/100
+
-
VGS
0
2
BV
DSS
/(
BV
DSS
V
DD
)
April 1998
5
Rev 1.000
相關(guān)PDF資料
PDF描述
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