參數(shù)資料
型號(hào)： BU1425AK
廠商： Rohm CO.,LTD.
英文描述： NTSC / PAL digital RGB encoder
中文描述： 的NTSC / PAL編碼器，數(shù)字RGB
文件頁(yè)數(shù)： 32/32頁(yè)
文件大小： 307K
代理商： BU1425AK
32
Multimedia ICs
BU1425AK / BU1425AKV
Reversal of the U and V timing using the H / L state of TEST[2] can be controlled regardless of whether CLKSW is
HIGH or LOW (the input clock is a doubled clock or not).
When using the RGB input mode, TEST[2] should be fixed at LOW.
In the Master mode, HSYNC is output at the timing shown in Fig. 26. For that reason, the timing of U and V should
be determined by counting from that falling edge. In the Slave mode, the HSY, U, and V data should be input at the
timing shown in Fig. 26.
Table 20
TEST2
(pin26)
CLKSW
(pin53)
0
0
1
1
0
1
0
1
In a doubled clock mode, the timing of U and V is as shown in Fig. 7-1.
In a regular clock mode, the timing of U and V is as shown in Fig. 7-1.
In a doubled clock mode, the timing of U and V is as shown in Fig. 7-2.
In a regular clock mode, the timing of U and V is as shown in Fig. 7-2.
External dimensions (Units: mm)
VQFP64
QFP-A64
BU1425AK
BU1425AKV
0.15
±
0.1
48
33
32
17
49
64
1
16
14.0
±
0.2
16.4
±
0.3
1
±
0.35
±
0.1
0
0
1
±
0.8
2
±
0
0.15
48
33
32
17
16
1
49
64
10.0
±
0.2
12.0
±
0.3
1
±
1
±
0.2
±
0.1
0.1
0.5
0.125
±
0.1
0
0
1
±
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