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參數(shù)資料
| 型號： | ATSAM3A4CA-CU |
| 廠商： | Atmel |
| 文件頁數(shù)： | 58/71頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 2X128KB CORTEX-M3 100-BGA |
| 標(biāo)準(zhǔn)包裝： | 260 |
| 系列： | SAM3A |
| 核心處理器： | ARM? Cortex?-M3 |
| 芯體尺寸： | 32-位 |
| 速度： | 84MHz |
| 連通性： | CAN，I²C，IrDA，LIN，MMC，SPI，SSC，UART/USART，USB |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，DMA，I²S，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 63 |
| 程序存儲器容量： | 256KB（256K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 64K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.62 V ~ 1.95 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 16x12b，D/A 2x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-TFBGA |
| 包裝： | 托盤 |
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63
11057BS–ATARM–13-Jul-12
SAM3X/A
63
11057BS–ATARM–13-Jul-12
SAM3X/A
– Each Slot for either a High Speed MultiMediaCard Bus (Up to 30 Cards) or an SD
Memory Card
Support for Stream, Block and Multi-block Data Read and Write
Supports Connection to DMA Controller (DMAC)
– Minimizes Processor Intervention for Large Buffer Transfers
Built in FIFO (from 16 to 256 bytes) with Large Memory Aperture Supporting Incremental
Access
Support for CE-ATA Completion Signal Disable Command
Protection Against Unexpected Modification On-the-Fly of the Configuration Registers
12.9
USB On-The-Go High Speed Port (UOTGHS)
USB2.0 Compliant, Low/Full/High-Speed (LS/FS/HS) and On-The-Go, 1.5Mb/s, 12Mb/s,
480Mb/s
10 Pipes/Endpoints
4K bytes of Embedded Dual-Port RAM (DPRAM) for Pipes/Endpoints
Up to 2 Memory Banks per Pipe/Endpoint (Not for Control Pipe/Endpoint)
Flexible Pipe/Endpoint Configuration and Management with 6 Dedicated DMA Channels
On-Chip UTMI transceiver including Pull-ups/Pull-downs
On-Chip OTG pad including VBUS analog comparator
12.10 Analog-to-Digital Converter (ADC)
12-bit Resolution
1 MHz Conversion Rate
2.4 V to 3.6 V Wide Range Power Supply Operation
Selectable Single Ended or Differential Input Voltage
Programmable Gain and Offset per channel For Maximum Full Scale Input Range 0 - VDD
Integrated Multiplexer Offering Up to 16 Independent Analog Inputs
Individual Enable and Disable of Each Channel
Hardware or Software Trigger
– External Trigger Pin
– Timer Counter Outputs (Corresponding TIOA Trigger)
– Internal Trigger Counter
– PWM Event Line
Drive of PWM Fault Input
PDC Support
Possibility of ADC Timings Configuration
Two Sleep Modes and Conversion Sequencer
– Automatic Wakeup on Trigger and Back to Sleep Mode after Conversions of all
Enabled Channels
– Possibility of Customized Channel Sequence
Standby Mode for Fast Wakeup Time Response
– Power Down Capability
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PDF描述 |
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