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參數(shù)資料
| 型號： | AT90PWM1-16SU |
| 廠商： | Atmel |
| 文件頁數(shù)： | 21/90頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU AVR 8K FLASH 16MHZ 24-SOIC |
| 產(chǎn)品培訓模塊： | MCU Product Line Introduction megaAVR Introduction |
| 標準包裝： | 1,116 |
| 系列： | AVR® 90PWM 照明 |
| 核心處理器： | AVR |
| 芯體尺寸： | 8-位 |
| 速度： | 16MHz |
| 連通性： | SPI |
| 外圍設備： | 欠壓檢測/復位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 19 |
| 程序存儲器容量： | 8KB（8K x 8） |
| 程序存儲器類型： | 閃存 |
| EEPROM 大小： | 512 x 8 |
| RAM 容量： | 512 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 24-SOIC（0.295"，7.50mm 寬） |
| 包裝： | 管件 |
| 配用： | ATSTK600-RC19-ND - STK600 ROUTING CARD AVR ATSTK600-SOIC-ND - STK600 SOCKET/ADAPTER FOR SOIC |
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28
4378C–AVR–09/08
AT90PWM1
7.1.3
Flash Clock – clk
FLASH
The Flash clock controls operation of the Flash interface. The Flash clock is usually active simul-
taneously with the CPU clock.
7.1.4
PLL Clock – clk
PLL
The PLL clock allows the PSC modules to be clocked directly from a 64/32 MHz clock. A 16 MHz
clock is also derived for the CPU.
7.1.5
ADC Clock – clk
ADC
The ADC is provided with a dedicated clock domain. This allows halting the CPU and I/O clocks
in order to reduce noise generated by digital circuitry. This gives more accurate ADC conversion
results.
7.2
Clock Sources
The device has the following clock source options, selectable by Flash Fuse bits as illustrated
Table 7-1. The clock from the selected source is input to the AVR clock generator, and routed to
the appropriate modules.
The various choices for each clocking option is given in the following sections. When the CPU
wakes up from Power-down or Power-save, the selected clock source is used to time the start-
up, ensuring stable Oscillator operation before instruction execution starts. When the CPU starts
from reset, there is an additional delay allowing the power to reach a stable level before starting
normal operation. The Watchdog Oscillator is used for timing this real-time part of the start-up
time. The number of WDT Oscillator cycles used for each time-out is shown in Table 7-2. The
Table 7-1.
Device Clocking Options Select AT90PWM1
Device Clocking Option
System
Clock
PLL Input
CKSEL3..0
(1)
1.For all fuses “1” means unprogrammed while “0” means programmed
External Crystal/Ceramic Resonator
Ext Osc
(2)
2.Ext Osc : External Osc
RC Osc
(3)
3.RC Osc : Internal RC Oscillator
1111 - 1000
PLL output divided by 4 : 16 MHz / PLL driven by External
Crystal/Ceramic Resonator
Ext Osc
0100
PLL output divided by 4 : 16 MHz / PLL driven by External
Crystal/Ceramic Resonator
PLL / 4
Ext Osc
0101
Reserved
N/A
0111- 0110
PLL output divided by 4 : 16 MHz
PLL / 4
RC Osc
0011
Calibrated Internal RC Oscillator
RC Osc
0010
PLL output divided by 4 : 16 MHz / PLL driven by External
clock
PLL / 4
Ext Clk
(4)
4.Ext Clk : External Clock Input
0001
External Clock
Ext Clk
RC Osc
0000
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