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參數(shù)資料
| 型號(hào)： | AT85C51SND3B1-7FTUL |
| 廠商： | Atmel |
| 文件頁數(shù)： | 46/119頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DECODER/ENCODER DGTL 100CBGA |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 類型： | 音頻編碼器/解碼器 |
| 應(yīng)用： | 移動(dòng)電話，手機(jī)，視頻顯示器 |
| 電壓 - 電源，數(shù)字： | 1.65 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-TFBGA |
| 供應(yīng)商設(shè)備封裝： | 100-CTBGA（9x9） |
| 包裝： | 托盤 |
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AT85C51SND3B
7632D–MP3–01/07
Figure 21. DFC/NFC Clock Generator Block Diagram and Symbol
Table 27. DFC/NFC Clock Selection
MMC Clock Generator
The MMC clock generator block diagram is shown in Figure 22 and is based on a fre-
quency selector followed by a frequency divider.
Frequency selection is done using MMCCKS2:0 bits in MMCCLK (see Table 35)
according to Table 28(1).
Frequency division is done using MMCDIV4:0 bits in MMCCLK according to Table 29.
Frequency configuration (selection and division) must be done prior to enable the MMC
clock generation by setting MMCKEN bit in CKEN.
Note:
1. To allow low frequency as low as 400 KHz (frequency needed in MMC identification
phase), FOSC selection can be divided by 2.
Figure 22. MMC Clock Generator Block Diagram and Symbol
DNFCKS2:0
Clock Selection (FS)
000
F
OSC (default)
001
60 MHz
010
48 MHz
011
40 MHz
100
30 MHz
101
24 MHz
110
20 MHz
111
16 MHz
DNFCKS2:0
CKSEL.7:5
CLOCK
GEN
000
001
010
011
100
101
110
111
60 MHz
48 MHz
40 MHz
30 MHz
24 MHz
20 MHz
16 MHz
DNFC
CLOCK
DFC/NFC Clock Symbol
DNFCKEN
CKEN.0
F
S
DFC Clock
OSC
NFC Clock
MMCKEN
CKEN.3
MMCCKS2:0
MMCCLK.7:5
000
001
010
011
100
101
110
111
60 MHz
48 MHz
30 MHz
24 MHz
20 MHz
16 MHz
MMC
CLOCK
MMC Clock Symbol
Clock
Divider
MMCDIV4:0
MMCCLK.4:0
F
S
MMC Clock
CLOCK
GEN
OSC
÷ 2
OSC
相關(guān)PDF資料 |
PDF描述 |
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| AT85C51SND3B1N-RTTUL | 功能描述:音頻 DSP Microcontroller RoHS:否 制造商:Texas Instruments 工作電源電壓: 電源電流: 工作溫度范圍: 安裝風(fēng)格: 封裝 / 箱體: 封裝:Tube |
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