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參數(shù)資料
| 型號(hào)： | ASM2I9940LG-32LT |
| 廠商： | ON Semiconductor |
| 文件頁(yè)數(shù)： | 8/10頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK BUFFER 2:18 250MHZ 32LQFP |
| 標(biāo)準(zhǔn)包裝： | 250 |
| 類型： | 扇出緩沖器（分配） |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:18 |
| 差分 - 輸入:輸出： | 是/無(wú) |
| 輸入： | LVCMOS，LVPECL |
| 輸出： | LVCMOS |
| 頻率 - 最大： | 250MHz |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應(yīng)商設(shè)備封裝： | 32-LQFP（7x7） |
| 包裝： | 托盤 |
ASM2I9940L
http://onsemi.com
7
V
÷2
CC
PECL_CLK
GND
V
Q
PP
VCMR
VCC
tPD
PECL_CLK
Figure 5. Propagation Delay (tPD) Test Reference
V
÷2
GND
V
CC
LVCMOS_CLK
Q
V
CC
t
CC
V
PD
÷2
CC
GND
Figure 6. LVCMOS Propagation Delay (tPD) Test Reference
The time from the PLL controlled edge to the
V
non-controlled edge, divided by the time
between PLL controlled edges, expressed as a
percentage.
V
CC
÷2
GND
DC (t
CC
÷T
P
Χ 100%)
t
0
T
P
0
Figure 7. Output Duty Cycle (DC)
t
V
SK(O)
V
OH
÷2
GND
V
CC
V
CC
÷2
GND
CC
The pin-to-pin skew is defined as the worst case
difference in propagation delay between any similar
delay path within a single device
Figure 8. Output–to–Output Skew tSK(O)
tR
V
= 3.3V V
CC
= 2.5V
CC
2.4
1.8V
0.55
tF
Figure 9. Output Transition Time Test Reference
tR
V
= 3.3V V
CC
= 2.5V
CC
2.0
0.8
tF
Figure 10. Input Transition Time Test Reference
0.6V
1.7V
0.7V
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