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參數(shù)資料
| 型號： | ASM2I9940LG-32LT |
| 廠商： | ON Semiconductor |
| 文件頁數(shù)： | 5/10頁 |
| 文件大小： | 0K |
| 描述： | IC CLK BUFFER 2:18 250MHZ 32LQFP |
| 標準包裝： | 250 |
| 類型： | 扇出緩沖器（分配） |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:18 |
| 差分 - 輸入:輸出： | 是/無 |
| 輸入： | LVCMOS，LVPECL |
| 輸出： | LVCMOS |
| 頻率 - 最大： | 250MHz |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應商設備封裝： | 32-LQFP（7x7） |
| 包裝： | 托盤 |
ASM2I9940L
http://onsemi.com
4
Table 6. AC CHARACTERISTICS (TA = 0°C to 70°C, VCCI = 3.3 V $ 5%, VCCO = 3.3 V $ 5%)
Symbol
Characteristic
Condition
Min
Typ
Max
Unit
Fmax
Maximum Input Frequency
250
MHz
tPLH
Propagation Delay
PECL_CLK v 150 MHz
CMOS_CLK v 150 MHz
(Note 1)
2.0
1.7
2.7
2.5
3.4
3.0
nS
tPLH
Propagation Delay
PECL_CLK > 150 MHz
CMOS_CLK > 150 MHz
2.0
1.8
2.9
2.5
3.7
3.2
nS
tsk(o)
Outputtooutput Skew
PECL_CLK
CMOS_CLK
(Note 1)
150
pS
tsk(pp)
ParttoPart Skew
PECL_CLK ≤ 150 MHz
CMOS_CLK ≤ 150 MHz
1.5
1.3
nS
tsk(pp)
ParttoPart Skew
PECL_CLK > 150 MHz
CMOS_CLK > 150 MHz
1.8
1.5
nS
tsk(pp)
ParttoPart Skew
PECL_CLK
CMOS_CLK
850
750
pS
DC
Output Duty Cycle
fCLK < 134 MHz
fCLK v 250 MHz
Input DC = 50%
45
40
50
55
60
%
tr, tf
Output Rise/Fall Time
0.5 – 2.4 V
0.3
1.1
nS
1. Tested using standard input levels, Production tested @ 150 MHz.
2. Across temperature and voltage ranges, includes output skew.
3. For a specific temperature and voltage, includes output skew.
Table 7. DC CHARACTERISTICS (TA = 0°C to 70°C, VCCI = 3.3 V $ 5%, VCCO = 2.5 V $ 5%)
Symbol
Characteristic
Condition
Min
Typ
Max
Unit
VIH
Input HIGH Voltage
CMOS_CLK
2.4
VCCI
V
VIL
Input LOW Voltage
CMOS_CLK
0.8
V
VPP
Peak–to–Peak Input Voltage
PECL_CLK
500
1000
mV
VCMR
Common Mode Range
PECL_CLK
VCCI – 1.4
VCCI – 0.6
V
VOH
Output HIGH Voltage
IOH = –12 mA
1.8
V
VOL
Output LOW Voltage
IOL = 12 mA
0.5
V
IIN
Input Current
$200
mA
CIN
Input Capacitance
4.0
pF
Cpd
Power Dissipation Capacitance
per output
10
pF
ZOUT
Output Impedance
23
W
ICC
Maximum Quiescent Supply Current
0.5
1.0
mA
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PDF描述 |
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相關代理商/技術參數(shù) |
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