ProASICPLUS Flash Family FPGAs v5.9 2-15 Figure 2-15 Using the PLL to De" />
參數(shù)資料
型號： APA300-CQ352B
廠商： Microsemi SoC
文件頁數(shù)： 97/178頁
文件大?。?/td> 0K
描述： IC FPGA PROASIC+ 300K 352-CQFP
標準包裝： 1
系列： ProASICPLUS
RAM 位總計： 73728
輸入/輸出數(shù)： 248
門數(shù)： 300000
電源電壓： 2.3 V ~ 2.7 V
安裝類型： 表面貼裝
封裝/外殼： 352-BFCQFP，帶拉桿
供應(yīng)商設(shè)備封裝： 352-CQFP（75x75）
ProASICPLUS Flash Family FPGAs
v5.9
2-15
Figure 2-15 Using the PLL to Delay the Input Clock
Figure 2-16 Using the PLL to Advance the Input Clock
÷n
÷m
÷u
÷v
D
PLL Core
External Feedback
Global MUX B OUT
Global MUX A OUT
GLB
GLA
0
180
133 MHz
÷1
÷n
÷m
÷u
÷v
D
PLL Core
External Feedback
Global MUX B OUT
Global MUX A OUT
GLB
GLA
0
180
133 MHz
÷1
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PDF描述
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