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參數(shù)資料
| 型號(hào)： | ADV3228ACPZ |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 2/24頁(yè) |
| 文件大小： | 0K |
| 描述： | IC CROSSPOINT SW 16X8 72LFCSP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 功能： | 交叉點(diǎn)開(kāi)關(guān) |
| 電路： | 1 x 8:8 |
| 電壓電源： | 雙電源 |
| 電壓 - 電源，單路/雙路(±)： | ±5V |
| 電流 - 電源： | 52mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類(lèi)型： | 表面貼裝 |
| 封裝/外殼： | 72-VFQFN 裸露焊盤(pán)，CSP |
| 供應(yīng)商設(shè)備封裝： | 72-LFCSP-VQ（10x10） |
| 包裝： | 托盤(pán) |
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ADV3228/ADV3229
Rev. 0 | Page 10 of 24
TRUTH TABLE AND LOGIC DIAGRAM
Table 8. Operation Truth Table1
CE
UPDATE
CLK
DATAIN
DATAOUT
RESET
SER/PAR
Description
1
X
No change in logic.
0
X
DataI2
DataI-80
X
0
The data on the serial DATAIN line is loaded into the
serial register. The first bit clocked into the serial
register appears at DATAOUT 40 clock cycles later.
0
X
0
D0…D3
Not applicable in
parallel mode3
X
1
The data on the parallel data lines, D0 to D3, are
loaded into the 40-bit serial shift register location
addressed at A0 to A2.
0
X
1
X
Data in the 40-bit shift register transfers into the
parallel latches that control the switch array. Latches
are transparent.
X
0
X
Asynchronous operation. All outputs are disabled.
Second rank latches are cleared. Remainder of logic
is unchanged.
1 X is don’t care.
2 DataI: serial data. Reserved bit internally set to Logic 1.
3 DATAOUT remains active in parallel mode and always reflects the state of the MSB of the serial shift register.
D
CLK
Q
3
T
O
8
D
E
CO
DE
R
A0
A1
A2
CLK
8
128
DATAIN
(SERIAL)
(OUTPUT
ENABLE)
SER/PAR
CE
UPDATE
OUT0 EN
DATA
OUT
PARALLEL
RESERVED
(INTERNALLY
SET HIGHT)
DATA
D Q
CLK
D Q
CLK
D Q
CLK
D Q
CLK
D1
D2
D Q
CLK
D Q
CLK
D Q
CLK
D Q
CLK
D Q
CLK
OUT1 EN
OUT2 EN
OUT3 EN
OUT4 EN
OUT5 EN
OUT6 EN
OUT7 EN
D
LE
Q
CLR
OUT7
EN
OUTPUT ENABLE
SWITCH MATRIX
S
D1
Q
D0
S
D1
Q
D0
S
D1
Q
D0
S
D1
Q
D0
S
D1
Q
D0
S
D1
Q
D0
S
D1
Q
D0
S
D1
Q
D0
D Q
CLK
S
D1
Q
D0
D3
DECODE
D
LE
Q
CLR
OUT0
EN
D
LE
OUT0
B0
Q
D
LE
Q
OUT0
B1
D
LE
Q
OUT0
B2
D
LE
Q
OUT0
R
D
LE
OUT1
B0
Q
D
LE
Q
CLR
OUT6
EN
D
LE
OUT7
B0
Q
D
LE
OUT7
B1
Q
D
LE
OUT7
B2
Q
D Q
CLK
S
D1
Q
D0
S
D1
Q
D0
D
LE
OUT7
R
Q
S
D1
Q
D0
OU
T
P
U
T
ADDRE
S
RESET
(OUTPUT ENABLE)
09
31
8-
0
06
Figure 6. Logic Diagram
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ADV601LCJSTZ | IC CODEC VIDEO DSP/SRL 120LQFP |
| ADV611JSTZ | IC CCTV DGTL VIDEO CODEC 120LQFP |
| ADV7120KPZ30 | IC DAC VIDEO 3CH 30MHZ 44PLCC |
| ADV7125WBCPZ170 | IC DAC VIDEO 3-CH 330MHZ 48VFQFN |
| ADV7171KSZ-REEL | IC DAC VIDEO ENC NTSC 44-MQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ADV3229ACPZ | 功能描述:IC CROSSPOINT SW 16X8 72LFCSP RoHS:是 類(lèi)別:集成電路 (IC) >> 接口 - 模擬開(kāi)關(guān)，多路復(fù)用器，多路分解器 系列:- 應(yīng)用說(shuō)明:Ultrasound Imaging Systems Application Note 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:250 系列:- 功能:開(kāi)關(guān) 電路:單刀單擲 導(dǎo)通狀態(tài)電阻:48 歐姆 電壓電源:單電源 電壓 - 電源，單路/雙路(±):2.7 V ~ 5.5 V 電流 - 電源:5µA 工作溫度:0°C ~ 70°C 安裝類(lèi)型:表面貼裝 封裝/外殼:48-LQFP 供應(yīng)商設(shè)備封裝:48-LQFP（7x7） 包裝:托盤(pán) |
| ADV32343001 | 制造商:LG Corporation 功能描述:Frame Assembly |
| ADV32368102 | 制造商:LG Corporation 功能描述:Frame Assembly |
| ADV32368601 | 制造商:LG Corporation 功能描述:Frame Assembly |
| ADV32369201 | 制造商:LG Corporation 功能描述:Frame Assembly |
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