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參數(shù)資料
| 型號(hào)： | ADSP-BF533SKBC600 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | Blackfin Embedded Processor |
| 中文描述： | 16-BIT, 50 MHz, OTHER DSP, PBGA160 |
| 封裝： | MO-205AE, CSBGA-160 |
| 文件頁數(shù)： | 37/56頁 |
| 文件大?。?/td> | 671K |
| 代理商： | ADSP-BF533SKBC600 |
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ADSP-BF531/ADSP-BF532/ADSP-BF533
Rev. 0
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March 2004
Timer Cycle Timing
Table 30
and
Figure 23
describe timer expired operations. The
input signal is asynchronous in “width capture mode” and
“external clock mode” and has an absolute maximum input fre-
quency of f
SCLK
/2 MHz.
Table 30. Timer Cycle Timing
Parameter
Timing Characteristics
t
WL
t
WH
Switching Characteristics
t
HTO
1
The minimum pulse widths apply for TMRx input pins in width capture and external clock modes. They also apply to the PF1 or PPI_CLK input pins in PWM output mode.
2
The minimum time for t
HTO
is one cycle, and the maximum time for t
HTO
equals (2
–1) cycles.
Min
Max
Unit
Timer Pulse Width Input Low
1
(Measured in SCLK Cycles)
Timer Pulse Width Input High
1
(Measured in SCLK Cycles)
1
1
SCLK
SCLK
Timer Pulse Width Output
2
(Measured in SCLK Cycles)
1
(2
32
–1)
SCLK
Figure 23. Timer PWM_OUT Cycle Timing
CLKOUT
TMRx
(PWM OUTPUT MODE)
t
HTO
TMRx
(WIDTH CAPTURE AND
EXTERNAL CLOCK MODES)
t
WL
t
WH
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ADSP-BF561SKBCZ600 | Blackfin Embedded Symmetric Multi-Processor |
| ADSP-BF561SKBCZ500 | Blackfin Embedded Symmetric Multi-Processor |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| ADSP-BF533SKBC750 | 制造商:Analog Devices 功能描述:DUAL MAC16-BIT756MHZ,148KB SRA |
| ADSP-BF533SKBC-C71 | 制造商:Analog Devices 功能描述: |
| ADSP-BF533SKBC-C90 | 制造商:Analog Devices 功能描述: |
| ADSP-BF533SKBCZ | 制造商:Analog Devices 功能描述:- Trays |
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