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參數(shù)資料
| 型號(hào)： | ADSP-BF504KCPZ-4F |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 30/80頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC CCD SIGNAL PROCESSOR 88LFCSP |
| 視頻文件： | Blackfin? BF50x Processor Family |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | Blackfin® |
| 類型： | 定點(diǎn) |
| 接口： | CAN，EBI/EMI，I²C，IrDA，PPI，SPI，SPORT，UART/USART |
| 時(shí)鐘速率： | 400MHz |
| 非易失內(nèi)存： | 閃存（16MB） |
| 芯片上RAM： | 68kB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.31V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 88-VFQFN 裸露焊盤(pán)，CSP |
| 供應(yīng)商設(shè)備封裝： | 88-LFCSP（12x12） |
| 包裝： | 托盤(pán) |
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Rev. A
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July 2011
ADSP-BF504/ADSP-BF504F/ADSP-BF506F
RSI Controller Timing
timing.
Table 28. RSI Controller Timing
Parameter
Min
Max
Unit
Timing Requirements
tISU
Input Setup Time
5.75
ns
tIH
Input Hold Time
2
ns
Switching Characteristics
fPP
1
Clock Frequency Data Transfer Mode
0
25
MHz
fOD
Clock Frequency Identification Mode
100
2
400
kHz
tWL
Clock Low Time
10
ns
tWH
Clock High Time
10
ns
tTLH
Clock Rise Time
10
ns
tTHL
Clock Fall Time
10
ns
tODLY
Output Delay Time During Data Transfer Mode
14
ns
tODLY
Output Delay Time During Identification Mode
50
ns
1 t
PP = 1/fPP
2 Specification can be 0 kHz, which means to stop the clock. The given minimum frequency range is for cases where a continuous clock is required.
Figure 18. RSI Controller Timing
SD_CLK
INPUT
OUTPUT
tISU
NOTES:
1 INPUT INCLUDES SD_Dx AND SD_CMD SIGNALS.
2 OUTPUT INCLUDES SD_Dx AND SD_CMD SIGNALS.
tTHL
tTLH
tWL
tWH
tPP
tIH
tODLY
VOH (MIN)
VOL (MAX)
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| ADSP-BF506BSWZ-4FX | 制造商:Analog Devices 功能描述:- Trays |
| ADSP-BF506F | 制造商:Analog Devices 功能描述:LOW POWER BLACKFIN WITH ADVANCED EMBEDDED CONNECTIVITY - Bulk |
| ADSPBF506FBSWZ-ENG | 制造商:Analog Devices 功能描述:- Trays |
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