JTAG Test And Emulation Port Timing Table 14 and Figure 17 describe JTAG port operations. Table 14. JTAG Port Timing Par" />
參數(shù)資料
型號(hào)： ADSP-21991BSTZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 28/44頁(yè)
文件大小： 0K
描述： IC DSP CONTROLLER 16BIT 176-LQFP
產(chǎn)品變化通告： Product Discontinuance 27/Oct/2011
標(biāo)準(zhǔn)包裝： 1
系列： ADSP-21xx
類型： 定點(diǎn)
接口： SPI，SSP
時(shí)鐘速率： 160MHz
非易失內(nèi)存： 外部
芯片上RAM： 112kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 2.50V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 176-LQFP
供應(yīng)商設(shè)備封裝： 176-LQFP（24x24）
包裝： 托盤(pán)
ADSP-21991
–34–
REV. 0
JTAG Test And Emulation Port Timing
Table 14 and Figure 17 describe JTAG port operations.
Table 14. JTAG Port Timing
Parameter
Min
Max
Unit
Timing Requirements
tTCK
TCK Period
20
ns
tSTAP
TDI, TMS Setup Before TCK High
4
ns
tHTAP
TDI, TMS Hold After TCK High
4
ns
tSSYS
System Inputs Setup Before TCK Low
1
4ns
tHSYS
System Inputs Hold After TCK Low
5ns
tTRSTW
TRST Pulsewidth2
4tTCK
ns
Switching Characteristics
tDTDO
TDO Delay from TCK Low
8
ns
tDSYS
System Outputs Delay After TCK Low
3
022
ns
1 System Outputs = DATA15–0, ADDR21–0,
MS3–0, RD, WR, ACK, CLKOUT, BG, PF15–0, DT, TCLK, RCLK, TFS, RFS, BMS.
2 50 MHz maximum.
3 System Inputs = DATA15–0, ADDR21–0,
RD, WR, ACK, BR, BG, PF15–0, DR, TCLK, RCLK, TFS, RFS, CLKOUT, RESET.
Figure 17. JTAG Port Timing
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
TCK
tTCK
tHTAP
tSTAP
tDTDO
tSSYS
tHSYS
tDSYS
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