Serial Peripheral Interface Port—Master Timing Table 12 and Figure 15 describe SPI port master operations. Table 12. Ser" />
參數(shù)資料
型號： ADSP-21991BSTZ
廠商： Analog Devices Inc
文件頁數(shù)： 26/44頁
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 16BIT 176-LQFP
產(chǎn)品變化通告： Product Discontinuance 27/Oct/2011
標(biāo)準(zhǔn)包裝： 1
系列： ADSP-21xx
類型： 定點
接口： SPI，SSP
時鐘速率： 160MHz
非易失內(nèi)存： 外部
芯片上RAM： 112kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 2.50V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 176-LQFP
供應(yīng)商設(shè)備封裝： 176-LQFP（24x24）
包裝： 托盤
ADSP-21991
–32–
REV. 0
Serial Peripheral Interface Port—Master Timing
Table 12 and Figure 15 describe SPI port master operations.
Table 12. Serial Peripheral Interface (SPI) Port—Master Timing
Parameter
Min
Max
Unit
Timing Requirements
tSSPID
Data Input Valid to SCLK Edge (Data Input Setup)
8
ns
tHSPID
SCLK Sampling Edge to Data Input Invalid (Data In Hold)
1
ns
Switching Characteristics
tSDSCIM
SPISEL Low to First SCLK Edge
2tHCLK–3
ns
tSPICHM
Serial Clock High Period
2tHCLK–3
ns
tSPICLM
Serial Clock Low Period
2tHCLK–3
ns
tSPICLK
Serial Clock Period
4tHCLK–1
ns
tHDSM
Last SCLK Edge to
SPISEL High
2tHCLK–3
ns
tSPITDM
Sequential Transfer Delay
2tHCLK–2
ns
tDDSPID
SCLK Edge to Data Output Valid (Data Out Delay)
0
6
ns
tHDSPID
SCLK Edge to Data Output Invalid (Data Out Hold)
0
5
ns
Figure 15. Serial Peripheral Interface (SPI) Port—Master Timing
tHSPID
tHDSPID
LSB
MSB
tHSPID
tDDSPID
MOSI
(OUTPUT)
MISO
(INPUT)
SPISEL
(OUTPUT)
SCLK
(CPOL = 0)
(OUTPUT)
SCLK
(CPOL = 1)
(OUTPUT)
tSPICHM
tSPICLM
tSPICLK
tSPICHM
tHDSM
tSPITDM
tHDSPID
LSB
VALID
LSB
MSB
VALID
tHSPID
tDDSPID
MOSI
(OUTPUT)
MISO
(INPUT)
tSSPID
tSDSCIM
tSSPID
CPHA = 1
CPHA = 0
MSB
VALID
LSB
VALID
tSSPID
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PDF描述
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ADSP-21992YST 制造商:Analog Devices 功能描述:
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