參數(shù)資料
型號(hào)： ADSP-2191MKCAZ-160
廠商： ANALOG DEVICES INC
元件分類(lèi)： 數(shù)字信號(hào)處理
英文描述： 16-bit Fixed-Point DSP, 160 MIPS, 160K bytes RAM; Package: CHIP SCALE BGA; No of Pins: 144; Temperature Range: Comm.
中文描述： 16-BIT, 100 MHz, OTHER DSP, PBGA144
封裝： MINI, BGA-144
文件頁(yè)數(shù)： 30/48頁(yè)
文件大?。?/td> 1789K
代理商： ADSP-2191MKCAZ-160
ADSP-2191M
–36–
REV. A
Serial Peripheral Interface (SPI) Port—Master Timing
Table 20 and Figure 21 describe SPI port master operations.
Table 20. Serial Peripheral Interface (SPI) Port—Master Timing
Parameter
Min
Max
Unit
Switching Characteristics
t
SDSCIM
SPIxSEL Low to First SCLK edge (x=0 or 1)
2t
HCLK –3
ns
t
SPICHM
Serial Clock High Period
2t
HCLK –3
ns
t
SPICLM
Serial Clock Low Period
2t
HCLK –3
ns
t
SPICLK
Serial Clock Period
4t
HCLK –1
ns
t
HDSM
Last SCLK Edge to
SPIxSEL High (x=0 or 1)
2t
HCLK –3
ns
t
SPITDM
Sequential Transfer Delay
2t
HCLK –2
ns
t
DDSPID
SCLK Edge to Data Output Valid (Data Out Delay)
0
6
ns
t
HDSPID
SCLK Edge to Data Output Invalid (Data Out Hold)
0
5
ns
Timing Requirements
t
SSPID
Data Input Valid to SCLK Edge (Data Input Setup)
8
ns
t
HSPID
SCLK Sampling Edge to Data Input Invalid (Data In Hold)
1
ns
Figure 21. Serial Peripheral Interface (SPI) Port—Master Timing
tHSPID
tHDSPID
LSB
MSB
tHSPID
tDDSPID
MOSI
(OUTPUT)
MISO
(INPUT)
SPIxSEL
(OUTPUT)
(x = 0 or 1)
SCLK
(CPOL = 0)
(OUTPUT)
SCLK
(CPOL = 1)
(OUTPUT)
tSPICHM
tSPICLM
tSPICLK
tSPICHM
tHDSM
tSPITDM
tHDSPID
LSB
VALID
LSB
MSB
VALID
tHSPID
tDDSPID
MOSI
(OUTPUT)
MISO
(INPUT)
tSSPID
CPHA = 0
MSB
VALID
tSDSCIM
tSSPID
LSB
VALID
CPHA = 1
tSSPID
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PDF描述
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