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參數(shù)資料
| 型號(hào)： | ADSP-2184NKSTZ-320 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 22/48頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 100LQFP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | ADSP-21xx |
| 類型： | 定點(diǎn) |
| 接口： | 主機(jī)接口，串行端口 |
| 時(shí)鐘速率： | 80MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 20kB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.80V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
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ADSP-218xN
Rev. A
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August 2006
Interrupts and Flags
Table 16. Interrupts and Flags
Parameter
Min
Max
Unit
Timing Requirements:
tIFS
IRQx, FI, or PFx Setup before CLKOUT Low1, 2, 3, 4
0.25tCK + 10
ns
tIFH
IRQx, FI, or PFx Hold after CLKOUT High1, 2, 3, 4
0.25tCK
ns
Switching Characteristics:
tFOH
Flag Output Hold after CLKOUT Low
5
0.5tCK – 5
ns
tFOD
Flag Output Delay from CLKOUT Low
0.5tCK + 4
ns
1 If IRQx and FI inputs meet tIFS and tIFH setup/hold requirements, they will be recognized during the current clock cycle; otherwise the signals will be recognized on the
following cycle. (Refer to “Interrupt Controller Operation” in the Program Control chapter of the ADSP-218x DSP Hardware Reference for further information on
interrupt servicing.)
2 Edge-sensitive interrupts require pulse widths greater than 10 ns; level-sensitive interrupts must be held low until serviced.
3 IRQx = IRQ0, IRQ1, IRQ2, IRQL0, IRQL1, IRQLE.
4 PFx = PF0, PF1, PF2, PF3, PF4, PF5, PF6, PF7.
5 Flag Outputs = PFx, FL0, FL1, FL2, FO.
Figure 27. Interrupts and Flags
tFOD
tFOH
tIFH
tIFS
CLKOUT
FLAG
OUTPUTS
IRQx
FI
PFx
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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