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參數(shù)資料
| 型號： | ADSP-2184NKSTZ-320 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 21/48頁 |
| 文件大小： | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 100LQFP |
| 標準包裝： | 1 |
| 系列： | ADSP-21xx |
| 類型： | 定點 |
| 接口： | 主機接口，串行端口 |
| 時鐘速率： | 80MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 20kB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.80V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應商設(shè)備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
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Rev. A
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August 2006
ADSP-218xN
Clock Signals and Reset
Table 15. Clock Signals and Reset
Parameter
Min
Max
Unit
Timing Requirements:
tCKI
CLKIN Period
25
40
ns
tCKIL
CLKIN Width Low
8
ns
tCKIH
CLKIN Width High
8
ns
Switching Characteristics:
tCKL
CLKOUT Width Low
0.5tCK – 3
ns
tCKH
CLKOUT Width High
0.5tCK – 3
ns
tCKOH
CLKIN High to CLKOUT High
0
8
ns
Control Signals Timing Requirements:
tRSP
RESET Width Low
5tCK
1
ns
tMS
Mode Setup before RESET High
7
ns
tMH
Mode Hold after RESET High
5
ns
1 Applies after power-up sequence is complete. Internal phase lock loop requires no more than 2000 CLKIN cycles, assuming stable CLKIN (not including crystal oscillator
start-up time).
Figure 26. Clock Signals and Reset
tCKOH
tCKI
tCKIH
tCKIL
tCKH
tCKL
tMH
tMS
CLKIN
CLKOUT
MODE A D
RESET
tRSP
相關(guān)PDF資料 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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