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參數資料
| 型號： | ADSP-21368BBPZ-2A |
| 廠商： | Analog Devices Inc |
| 文件頁數： | 40/64頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP 32BIT 333MHZ 256-BGA |
| 產品培訓模塊： | SHARC Processor Overview |
| 標準包裝： | 1 |
| 系列： | SHARC® |
| 類型： | 浮點 |
| 接口： | DAI，DPI |
| 時鐘速率： | 333MHz |
| 非易失內存： | ROM（768 kB） |
| 芯片上RAM： | 256kB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.20V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-LBGA 裸露焊盤 |
| 供應商設備封裝： | 256-BGA（27x27） |
| 包裝： | 托盤 |
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Rev. F
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October 2013
Figure 33 shows the left-justified mode. LRCLK is high for the
left channel and low for the right channel. Data is valid on the
rising edge of SCLK. The MSB is left-justified to an LRCLK
transition with no MSB delay.
S/PDIF Transmitter Input Data Timing
The timing requirements for the input port are given in
Table 37. Input signals SCLK, frame sync (FS), and SDATA are
routed to the DAI_P20–1 pins using the SRU. Therefore, the
timing specifications provided below are valid at the
DAI_P20–1 pins.
Figure 33. Left-Justified Mode
MSB
LEFT/RIGHT CHANNEL
LSB
MSB–1 MSB–2
LSB+2
LSB+1
DAI_P20–1
FS
DAI_P20–1
SCLK
DAI_P20–1
SDATA
tLJD
Table 37. S/PDIF Transmitter Input Data Timing
Parameter
Min
Max
Unit
Timing Requirements
t
SISFS
1
FS Setup Before SCLK Rising Edge
3
ns
t
SIHFS
1
FS Hold After SCLK Rising Edge
3
ns
t
SISD
1
SDATA Setup Before SCLK Rising Edge
3
ns
t
SIHD
1
SDATA Hold After SCLK Rising Edge
3
ns
t
SISCLKW
Clock Width
36
ns
t
SISCLK
Clock Period
80
ns
t
SITXCLKW
Transmit Clock Width
9
ns
t
SITXCLK
Transmit Clock Period
20
ns
1 DATA, SCLK, and FS can come from any of the DAI pins. SCLK and FS can also come via PCG or SPORTs. PCG’s input can be either CLKIN or any of the DAI pins.
相關PDF資料 |
PDF描述 |
|---|---|
| HWS300-24 | PWR SUP IND 24V 14A SNG OUTPUT |
| ADSP-21065LKCAZ264 | IC DSP CTLR 32BIT 196CSPBGA |
| TAJY107M006RNJ | CAP TANT 100UF 6.3V 20% 2917 |
| GMM08DRSN-S288 | CONN EDGECARD 16POS .156 EXTEND |
| ABB60DHFD-S578 | EDGECARD 120POS PCI32 .050 SMD |
相關代理商/技術參數 |
參數描述 |
|---|---|
| adsp-21368kbp-2a | 制造商:Rochester Electronics LLC 功能描述: 制造商:Analog Devices 功能描述: |
| ADSP-21368KBP-2AZ | 制造商:Analog Devices 功能描述:DSP 32BIT SHARC 333MHZ 256BGA 制造商:Analog Devices 功能描述:DSP, 32BIT, SHARC, 333MHZ, 256BGA |
| ADSP-21368KBP-ENG | 制造商:Analog Devices 功能描述: |
| ADSP-21368KBPZ-2A | 功能描述:IC DSP 32BIT 333MHZ 256-BGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數字式信號處理器） 系列:SHARC® 標準包裝:2 系列:StarCore 類型:SC140 內核 接口:DSI，以太網，RS-232 時鐘速率:400MHz 非易失內存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，FCBGA 供應商設備封裝:431-FCPBGA（20x20） 包裝:托盤 |
| ADSP-21368KBPZ-3A | 功能描述:IC DSP 32BIT 400MHZ 256BGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數字式信號處理器） 系列:SHARC® 標準包裝:2 系列:StarCore 類型:SC140 內核 接口:DSI，以太網，RS-232 時鐘速率:400MHz 非易失內存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，FCBGA 供應商設備封裝:431-FCPBGA（20x20） 包裝:托盤 |
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