VREF V
參數(shù)資料
型號(hào)： ADCLK914BCPZ-WP
廠商： Analog Devices Inc
文件頁數(shù)： 2/12頁
文件大?。?/td> 0K
描述： IC CLK/DATA BUFF DVR 1:1 16LFCSP
標(biāo)準(zhǔn)包裝： 50
系列： SIGe
類型： 緩沖器/驅(qū)動(dòng)器，數(shù)據(jù)
電路數(shù)： 1
比率 - 輸入:輸出： 1:1
差分 - 輸入:輸出： 是/是
輸入： CML，CMOS，LVDS，LVPECL，LVTTL
輸出： HVDS
頻率 - 最大： 7.5GHz
電源電壓： 2.97 V ~ 3.63 V
工作溫度： -40°C ~ 125°C
安裝類型： 表面貼裝
封裝/外殼： 16-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 16-LFCSP-VQ
包裝： 托盤 - 晶粒
ADCLK914
Rev. A | Page 10 of 12
TYPICAL APPLICATION CIRCUITS
VREF
VCC
VT
D
CONNECT VT TO VCC.
065
61
-01
7
Figure 15. Interfacing to CML Inputs
VREF
VT
D
NOTES
1. PLACING A BYPASS CAPACITOR
FROM VT TO GROUND CAN IMPROVE
THE NOISE PERFORMANCE.
CONNECT VT TO VREF.
06
56
1
-01
9
Figure 16. AC Coupling Differential Signals
VEE
40mA
VEE
7mA
VEE
7mA
Q
VCC
06561-
021
Figure 17. Interfacing to High Speed DAC
VREF
VCC – 2V
VT
D
CONNECT VT TO VCC – 2V. 065
61
-01
8
Figure 18. Interfacing to ECL Inputs
VREF
VT
D
CONNECT VT, VREF, AND D. PLACE A BYPASS
CAPACITOR FROM VT TO GROUND.
ALTERNATIVELY, VT, VREF, AND D CAN BE
CONNECTED, GIVING A CLEANER LAYOUT AND
A 180 PHASE SHIFT.
06
56
1-
0
20
Figure 19. Interfacing to AC-Coupled, Single-Ended Inputs
相關(guān)PDF資料
PDF描述
ADCLK944BCPZ-R7 IC CLOCK BUFFER 1:4 7GHZ 16LFCSP
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ADCLK925BCPZ-TR 制造商:Analog Devices 功能描述:1:2 ECL,,7 GBPPS CLOCK/DATA BUFFERS - Tape and Reel
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