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參數資料
| 型號： | AD9910 |
| 廠商： | Analog Devices, Inc. |
| 元件分類： | XO, clock |
| 英文描述： | 1 GSPS, 14-Bit, 3.3 V CMOS Direct Digital Synthesizer |
| 中文描述： | 1 GSPS的，14位，3.3伏的CMOS直接數字頻率合成 |
| 文件頁數： | 42/60頁 |
| 文件大小： | 764K |
| 代理商： | AD9910 |
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AD9910
Software control requires that the EXT_PWR_DWN pin be
forced to a Logic 0 state. In this case, setting the desired power-
down bits (via the serial I/O port) powers down the associated
functional block, whereas clearing the bits restores the function.
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Alternatively, all four functions can be simultaneously powered
down via external hardware control through the EXT_PWR_DWN
pin. When this pin is forced to Logic 1, all four circuit blocks are
powered down regardless of the state of the power-down bits.
That is, the independent power-down bits in CFR1 are ignored
and overridden when EXT_PWR_DWN is Logic 1.
Based on the state of the external power-down control bit, the
EXT_PWR_DWN pin produces either a full power-down or a
fast recovery power-down. The fast recovery power-down mode
maintains power to the DAC bias circuitry and the PLL, VCO,
and input clock circuitry. Although the fast recovery power-
down does not conserve as much power as the full power-down,
it allows the device to awaken very quickly from the power-
down state.
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PDF描述 |
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