MAXIMUM DAC IOUT – mA 40 5 SFDR – dBc 10 15 20 45 50 55 60 65 70 1.1M" />
參數資料
型號： AD9851BRSRL
廠商： Analog Devices Inc
文件頁數： 24/24頁
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描述： IC DDS/DAC SYNTHESIZER 28-SSOP
產品培訓模塊： Direct Digital Synthesis Tutorial Series (1 of 7): Introduction
Direct Digital Synthesizer Tutorial Series (7 of 7): DDS in Action
Direct Digital Synthesis Tutorial Series (3 of 7): Angle to Amplitude Converter
Direct Digital Synthesis Tutorial Series (6 of 7): SINC Envelope Correction
Direct Digital Synthesis Tutorial Series (4 of 7): Digital-to-Analog Converter
Direct Digital Synthesis Tutorial Series (2 of 7): The Accumulator
標準包裝： 1,500
分辨率（位）： 10 b
主 fclk： 180MHz
調節(jié)字寬（位）： 32 b
電源電壓： 2.7 V ~ 5.25 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 28-SSOP（0.209"，5.30mm 寬）
供應商設備封裝： 28-SSOP
包裝： 帶卷 (TR)
AD9851
–9–
MAXIMUM DAC IOUT – mA
40
5
SFDR
–
dBc
10
15
20
45
50
55
60
65
70
1.1MHz
40.1MHz
70.1MHz
TPC 17. Effect of DAC maximum output current on
wideband (0 to 72 MHz) SFDR at three representa-
tive DAC output frequencies: 1.1 MHz, 40.1 MHz,
and 70.1 MHz. VS
and 70.1 MHz. V
and 70.1 MHz. V = 5 V, 180 MHz system clock (6
S
REFCLK multiplier disabled). Currents are set using
appropriate values of RSET.
SET
INPUT FREQUENCY – MHz
0
p-p
AMPLITUDE
–
m
V
20
40
60
80
100
120
140
160
100
200
300
400
500
600
VS = +3.3V
VS = +5V
TPC 18. Minimum p-p input signal needed to tog-
gle the AD9851 comparator output. Comparator
input is a sine wave compared with a fixed volt-
age threshold. Use this data in addition to sin(x)/x
rolloff and any filter losses to determine whether
adequate signal is being presented to the AD9851
comparator.
REV. D
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PDF描述
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MCF51JE256CLK IC MCU 32BIT 256K FLASH 80LQFP
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VE-BWY-IY-F4 CONVERTER MOD DC/DC 3.3V 33W
VE-BWY-IX-F3 CONVERTER MOD DC/DC 3.3V 49.5W
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參數描述
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