參數(shù)資料
型號(hào)： AD9553/PCBZ
廠商： Analog Devices Inc
文件頁數(shù)： 43/44頁
文件大?。?/td> 0K
描述： BOARD EVAL FOR AD9553
設(shè)計(jì)資源： AD9553 Eval Brd BOM
AD9553 Eval Brd Schematic
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，時(shí)鐘緩沖器 / 驅(qū)動(dòng)器 / 接收器 / 變換器
已用 IC / 零件： AD9553
已供物品： 板
相關(guān)產(chǎn)品： AD9553BCPZ-ND - IC INTEGER-N CLCK GEN 32LFCSP
AD9553BCPZ-REEL7-ND - IC INTEGER-N CLCK GEN 32LFCSP
AD9553
Rev. A | Page 8 of 44
SERIAL CONTROL PORT
Table 10.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
CS
Input Logic 1 Voltage
1.6
V
Input Logic 0 Voltage
0.5
V
Input Logic 1 Current
0.03
A
Input Logic 0 Current
2
A
Input Capacitance
2
pF
SCLK
Input Logic 1 Voltage
1.6
V
Input Logic 0 Voltage
0.5
V
Input Logic 1 Current
2
A
Input Logic 0 Current
0.03
A
Input Capacitance
2
pF
SDIO
Input
Input Logic 1 Voltage
1.6
V
Input Logic 0 Voltage
0.5
V
Input Logic 1 Current
1
A
Input Logic 0 Current
1
A
Input Capacitance
2
pF
Output
Output Logic 1 Voltage
2.8
V
1 mA load current
Output Logic 0 Voltage
0.3
V
1 mA load current
SERIAL CONTROL PORT TIMING
Table 11.
Parameter
Limit
Unit
SCLK
Clock Rate, 1/t
CLK
50
MHz max
Pulse Width High, t
HIGH
3
ns min
Pulse Width Low, t
LOW
3
ns min
SDIO to SCLK Setup, t
DS
4
ns min
SCLK to SDIO Hold, t
DH
0
ns min
SCLK to Valid SDIO, t
DV
13
ns max
CS to SCLK Setup (tS) and Hold (tH)
0
ns min
CS Minimum Pulse Width High
6.4
ns min
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PDF描述
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參數(shù)描述
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AD9554-1/PCBZ 功能描述:AD9554-1 - Timing, Clock Generator Evaluation Board 制造商:analog devices inc. 系列:- 零件狀態(tài):有效 主要用途:計(jì)時(shí)，時(shí)鐘發(fā)生器 嵌入式:- 使用的 IC/零件:AD9554-1 主要屬性:- 輔助屬性:LED 狀態(tài)指示器 所含物品:板 標(biāo)準(zhǔn)包裝:1
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AD9554-1BCPZ-REEL7 功能描述:IC PLL CLOCK GEN 4OUT 72LFCSP 制造商:analog devices inc. 系列:- 包裝:帶卷（TR） 零件狀態(tài):有效 PLL:是 主要用途:以太網(wǎng)，SONET/SDH，Stratum 輸入:CMOS，LVDS 輸出:HCSL，LVDS，LVPECL 電路數(shù):1 比率 - 輸入:輸出:4：4 差分 - 輸入:輸出:是/是 頻率 - 最大值:942MHz 電壓 - 電源:1.4 V ~ 2.625 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:56-WFQFN 裸焊盤，CSP 供應(yīng)商器件封裝:56-LFCSP-WQ（8x8） 標(biāo)準(zhǔn)包裝:750
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