- 您現(xiàn)在的位置：買賣IC網 > PDF目錄16543 > AD9553/PCBZ (Analog Devices Inc)BOARD EVAL FOR AD9553 PDF資料下載
參數(shù)資料
| 型號： | AD9553/PCBZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 18/44頁 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR AD9553 |
| 設計資源： | AD9553 Eval Brd BOM AD9553 Eval Brd Schematic |
| 標準包裝： | 1 |
| 主要目的： | 計時，時鐘緩沖器 / 驅動器 / 接收器 / 變換器 |
| 已用 IC / 零件： | AD9553 |
| 已供物品： | 板 |
| 相關產品： | AD9553BCPZ-ND - IC INTEGER-N CLCK GEN 32LFCSP AD9553BCPZ-REEL7-ND - IC INTEGER-N CLCK GEN 32LFCSP |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁當前第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁
AD9553
Rev. A | Page 25 of 44
PIN
DECODE
LOGIC
OM[2:0]
0
1
3
DRIVER
OUT1
OUTPUT
CONTROL
OUTPUT
CONTROL
2
3
DRIVE
STRENGTH
REGISTER 0x32
REGISTER 0x34
MODE
CONTROL
ENABLE
SPI
CONTROL
POWER-
DOWN
CMOS
POLARITY
DRIVE
STRENGTH
MODE
CONTROL
POWER-
DOWN
CMOS
POLARITY
2
DRIVER
OUT2
2
0
1
2
3
MODE
CONTROL
0
REGISTER
DEFAULT VALUES
SHOWN IN RED
101
00
0
1
0
101
00
0
1
3
ENABLE
SPI
CONTROL
BITS
[5:3]
BITS
[2:1]
BIT 0
BIT 7
BIT 6
BITS
[5:3]
BITS
[2:1]
BIT 0
BIT 7
BIT 6
08565-
104
Figure 31. Output Driver Control
Output Driver Polarity (CMOS)
When the mode control bits indicate the CMOS logic family
(see Table 19), the user has control of the logic polarity asso-
ciated with each CMOS output pin. Driver polarity defines how
the logic level (Logic 1 or Logic 0) at a CMOS output pin relates
to the logic state (logic true or logic false). Normal polarity
equates Logic 1/Logic 0 to logic true/logic false, while inverted
polarity equates Logic 0/Logic 1 to logic true/logic false. Bit[2]
of the OUT1 and OUT2 driver control registers establishes the
CMOS polarity of the associated output driver (see Figure 31).
Output Drive Strength (CMOS or LVDS)
When the mode bits indicate the CMOS or LVDS logic family
(see Table 19), the user can select whether the output driver
uses weak or strong drive capability. Bit 7 of the OUT1 and
OUT2 driver control registers control the drive strength of
the associated output driver (see Figure 31). In the case of the
CMOS family, the strong setting allows for driving increased
capacitive loads. In the case of the LVDS family, the nominal
weak and strong drive currents are 3.5 mA and 7 mA, respectively.
Output Power Down
The AD9553 supports the option of independent power-down
of the output drivers. Bit 6 of the OUT1 and OUT2 driver control
registers controls the power-down function (see Figure 31). When
Bit 6 is Logic 0, the associated output driver is active. When Bit 6 is
Logic 1, the associated output driver is in power-down mode.
相關PDF資料 |
PDF描述 |
|---|---|
| ECE-T2WA561EA | CAP ALUM 560UF 450V 20% SNAP |
| 5503995-1 | CABLE ASSEM FIBER ST-ST 1 METER |
| M1BXK-2436J | IDC CABLE - MSR24K/MC24G/X |
| 5504970-5 | CABLE ASSEM FIBER SC-SC 10METER |
| AD812AR-EBZ | BOARD EVAL FOR AD812AR |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| AD9554/PCBZ | 功能描述:AD9554 - Timing, Clock Generator Evaluation Board 制造商:analog devices inc. 系列:- 零件狀態(tài):有效 主要用途:計時，時鐘發(fā)生器 嵌入式:- 使用的 IC/零件:AD9554 主要屬性:- 輔助屬性:LED 狀態(tài)指示器 所含物品:板 標準包裝:1 |
| AD9554-1/PCBZ | 功能描述:AD9554-1 - Timing, Clock Generator Evaluation Board 制造商:analog devices inc. 系列:- 零件狀態(tài):有效 主要用途:計時，時鐘發(fā)生器 嵌入式:- 使用的 IC/零件:AD9554-1 主要屬性:- 輔助屬性:LED 狀態(tài)指示器 所含物品:板 標準包裝:1 |
| AD9554-1BCPZ | 功能描述:IC PLL CLOCK GEN 4OUT 72LFCSP 制造商:analog devices inc. 系列:- 包裝:托盤 零件狀態(tài):有效 PLL:是 主要用途:以太網，SONET/SDH，Stratum 輸入:CMOS，LVDS 輸出:HCSL，LVDS，LVPECL 電路數(shù):1 比率 - 輸入:輸出:4：4 差分 - 輸入:輸出:是/是 頻率 - 最大值:942MHz 電壓 - 電源:1.4 V ~ 2.625 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:56-WFQFN 裸焊盤，CSP 供應商器件封裝:56-LFCSP-WQ（8x8） 標準包裝:1 |
| AD9554-1BCPZ-REEL7 | 功能描述:IC PLL CLOCK GEN 4OUT 72LFCSP 制造商:analog devices inc. 系列:- 包裝:帶卷（TR） 零件狀態(tài):有效 PLL:是 主要用途:以太網，SONET/SDH，Stratum 輸入:CMOS，LVDS 輸出:HCSL，LVDS，LVPECL 電路數(shù):1 比率 - 輸入:輸出:4：4 差分 - 輸入:輸出:是/是 頻率 - 最大值:942MHz 電壓 - 電源:1.4 V ~ 2.625 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:56-WFQFN 裸焊盤，CSP 供應商器件封裝:56-LFCSP-WQ（8x8） 標準包裝:750 |
| AD9554BCPZ | 功能描述:IC CLOCK TRANSLATOR 8OUT 72LFCSP 制造商:analog devices inc. 系列:- 包裝:托盤 零件狀態(tài):有效 PLL:是 主要用途:以太網，SONET/SDH，Stratum 輸入:CMOS，LVDS 輸出:HCSL，LVDS，LVPECL 電路數(shù):1 比率 - 輸入:輸出:4：8 差分 - 輸入:輸出:是/是 頻率 - 最大值:941MHz 電壓 - 電源:1.47 V ~ 1.89 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:72-VFQFN 裸露焊盤，CSP 供應商器件封裝:72-LFCSP-VQ（10x10） 標準包裝:1 |
發(fā)布緊急采購，3分鐘左右您將得到回復。