參數(shù)資料
型號： AD9522-4BCPZ
廠商： ANALOG DEVICES INC
元件分類： 時鐘產(chǎn)生/分配
英文描述： OTHER CLOCK GENERATOR, QCC64
封裝： 9 X 9 MM, ROHS COMPLIANT, MO-220VMMD-4, LFCSP-64
文件頁數(shù)： 15/84頁
文件大?。?/td> 1606K
代理商： AD9522-4BCPZ
AD9522-4
Rev. 0 | Page 22 of 84
0.4
–0.4
–0.3
–0.2
–0.1
0
0.1
0.2
0.3
03
2.5
2.0
1.5
1.0
0.5
D
IFF
E
R
E
N
TIA
L
S
W
IN
G
(V
p-
p
)
TIME (ns)
07
22
5-
0
15
.0
Figure 18. LVDS Differential Voltage Swing @ 800 MHz
Output Terminated 100 Ω Across Differential Pair
3.2
2.8
2.4
2.0
1.6
1.2
0.8
0.4
0
08
60
100
40
20
70
50
90
30
10
AM
P
L
IT
UDE
(
V
)
TIME (ns)
0
07
22
5-
0
18
Figure 19. CMOS Output with 10 pF Load @ 25 MHz
3.2
2.8
2.4
2.0
1.6
1.2
0.8
0.4
0
010
9
8
7
6
5
4
3
2
1
AM
P
L
IT
U
DE
(
V
)
TIME (ns)
2pF LOAD
10pF
LOAD
07
22
5-
0
19
Figure 20. CMOS Output with 2 pF and 10 pF Load @ 250 MHz
1600
1400
1200
1000
800
600
400
200
0
1000
600
800
400
200
D
IFF
E
R
E
N
TIA
L
S
W
IN
G
(m
V
p
-p)
FREQUENCY (GHz)
07
22
5-
1
23
7mA SETTING
DEFAULT 3.5mA SETTING
Figure 21. LVDS Differential Voltage Swing vs. Frequency
Output Terminated 100 Ω Across Differential Pair
4.0
3.5
3.0
2.5
2.0
1.5
1.0
0.5
0
07
2pF
10pF
20pF
600
500
400
300
200
100
A
M
P
L
IT
UDE
(
V
)
FREQUENCY (MHz)
00
07
22
5-
1
24
Figure 22. CMOS Output Swing vs. Frequency and Capacitive Load
–50
–160
–150
–140
–130
–120
–110
–100
–90
–80
–70
–60
1k
100M
1M
10M
100k
10k
PH
A
S
E
N
O
ISE
(
d
B
c/
H
z)
FREQUENCY (Hz)
07
22
5-
0
23
Figure 23. Internal VCO Phase Noise (Absolute), LVDS Output @ 467 MHz
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PDF描述
AD9575ARUZLVD Network Clock Generator, Two Outputs, TSSOP 4.4 MM, No of Pins: 16
AD9575ARUZPEC Network Clock Generator, Two Outputs, TSSOP 4.4 MM, No of Pins: 16
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ADC1113D125HN Dual 11 bits ADC; 125 Msps; serial JESD204A
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參數(shù)描述
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AD9522-5 制造商:AD 制造商全稱:Analog Devices 功能描述:12 LVDS/24 CMOS Output Clock Generator
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