參數(shù)資料
型號： AD9515/PCBZ
廠商： Analog Devices Inc
文件頁數(shù)： 26/28頁
文件大?。?/td> 0K
描述： BOARD EVAL CLOCK 2CH AD9515
設(shè)計資源： Low Jitter Sampling Clock Generator for High Performance ADCs Using AD9958/9858 and AD9515 (CN0109)
AD9513/14/15 Eval Brd Schematics
AD9513/14/15 Gerber Files
AD9515 Eval Brd BOM
標(biāo)準(zhǔn)包裝： 1
主要目的： 計時，時鐘分配
已用 IC / 零件： AD9515
已供物品： 板
相關(guān)產(chǎn)品： AD9515BCPZ-ND - IC CLOCK DIST 2OUT PLL 32LFCSP
AD9515BCPZ-REEL7-ND - IC CLOCK DIST 2OUT PLL 32LFCSP
Data Sheet
AD9515
Rev. A | Page 7 of 28
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
CLK = 491.52 MHz, OUT = 122.88 MHz
Divide = 4
@ 10 Hz Offset
118
dBc/Hz
@ 100 Hz Offset
129
dBc/Hz
@ 1 kHz Offset
136
dBc/Hz
@ 10 kHz Offset
147
dBc/Hz
@ 100 kHz Offset
153
dBc/Hz
@ 1 MHz Offset
156
dBc/Hz
>10 MHz Offset
158
dBc/Hz
CLK = 245.76 MHz, OUT = 245.76 MHz
Divide = 1
@ 10 Hz Offset
108
dBc/Hz
@ 100 Hz Offset
118
dBc/Hz
@ 1 kHz Offset
128
dBc/Hz
@ 10 kHz Offset
138
dBc/Hz
@ 100 kHz Offset
145
dBc/Hz
@ 1 MHz Offset
148
dBc/Hz
>10 MHz Offset
155
dBc/Hz
CLK = 245.76 MHz, OUT = 122.88 MHz
Divide = 2
@ 10 Hz Offset
118
dBc/Hz
@ 100 Hz Offset
127
dBc/Hz
@ 1 kHz Offset
137
dBc/Hz
@ 10 kHz Offset
147
dBc/Hz
@ 100 kHz Offset
154
dBc/Hz
@ 1 MHz Offset
156
dBc/Hz
>10 MHz Offset
158
dBc/Hz
CLK-TO-CMOS ADDITIVE PHASE NOISE
CLK = 245.76 MHz, OUT = 245.76 MHz
Divide = 1
@ 10 Hz Offset
110
dBc/Hz
@ 100 Hz Offset
121
dBc/Hz
@ 1 kHz Offset
130
dBc/Hz
@ 10 kHz Offset
140
dBc/Hz
@ 100 kHz Offset
145
dBc/Hz
@ 1 MHz Offset
149
dBc/Hz
>10 MHz Offset
156
dBc/Hz
CLK = 245.76 MHz, OUT = 61.44 MHz
Divide = 4
@ 10 Hz Offset
125
dBc/Hz
@ 100 Hz Offset
132
dBc/Hz
@ 1 kHz Offset
143
dBc/Hz
@ 10 kHz Offset
152
dBc/Hz
@ 100 kHz Offset
158
dBc/Hz
@ 1 MHz Offset
160
dBc/Hz
>10 MHz Offset
162
dBc/Hz
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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