參數(shù)資料
型號(hào)： AD9148BBPZRL
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 6/72頁(yè)
文件大小： 0K
描述： IC DAC 16BIT SPI/SRL 196BGA
標(biāo)準(zhǔn)包裝： 1,500
系列： TxDAC+®
設(shè)置時(shí)間： 20ns
位數(shù)： 16
數(shù)據(jù)接口： 串行，SPI?
轉(zhuǎn)換器數(shù)目： 4
電壓電源： 單電源
功率耗散（最大）： 2.67W
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 196-LFBGA 裸露焊盤
供應(yīng)商設(shè)備封裝： 196-BGA
包裝： 帶卷 (TR)
輸出數(shù)目和類型： 4 電流，單極
采樣率（每秒）： 1G
AD9148
Data Sheet
Rev. B | Page 14 of 72
Pin No.
Mnemonic
Description
M7, L7
B6_P/B6_N
LVDS Data Input Pair, Port B.
M8, L8
B7_P/B7_N
LVDS Data Input Pair, Port B.
M9, L9
B8_P/B8_N
LVDS Data Input Pair, Port B.
M10, L10
B9_P/B9_N
LVDS Data Input Pair, Port B.
M11, L11
B10_P/B10_N
LVDS Data Input Pair, Port B.
K11, J11
B11_P/B11_N
LVDS Data Input Pair, Port B.
M12, L12
B12_P/B12_N
LVDS Data Input Pair, Port B.
K12, J12
B13_P/B13_N
LVDS Data Input Pair, Port B.
M13, L13
B14_P/B14_N
LVDS Data Input Pair, Port B.
M14, L14
B15_P/B15_N
LVDS Data Input Pair, Port B (MSB).
K2, J2
DCIB_P/DCIB_N
LVDS Data Clock Input Pair for Port B.
K1, J1
FRAMEB_P/FRAMEB_N
LVDS Frame Input for Port B. Tie to LVDS logic low if not used.
Recommended external bias circuit is shown in Figure 49.
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