參數(shù)資料
型號： AD8152JBP
廠商： Analog Devices Inc
文件頁數(shù)： 7/32頁
文件大小： 0K
描述： IC CROSSPOINT SWIT 34X34 256BGA
標(biāo)準(zhǔn)包裝： 1
系列： XStream™
功能： 交叉點(diǎn)開關(guān)
電路： 1 x 34:34
電壓電源： 單電源
電壓 - 電源，單路/雙路(±)： 2.25 V ~ 3.63 V
工作溫度： 0°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 256-LBGA 裸露焊盤
供應(yīng)商設(shè)備封裝： 256-SBGA（27x27）
包裝： 托盤
REV. A
AD8152
–15–
CS
UPDATE
INPUT {DATA 1}
WE
ENABLING
OUT[0:33][N:P]
OUTPUTS
DISABLING
OUT[0:33][N:P]
OUTPUTS
INPUT {DATA 1}
INPUT {DATA 0}
tCSU
tUOT
tUOE
tUW
tWOT
tWOD
tWHU
tCHU
INPUT {DATA 2}
Figure 4a. Transparent Write and Update Cycle
Table VII. Transparent Update Cycle
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
tCSU
Setup Time
Chip Select to Update
TA = 25 C0
ns
tCHU
Hold Time
Chip Select from Update
VCC = 3.3 V
0
ns
tUOE
Output Enable Times
Update to Output Enable
35
50
ns
tWOE*
Write Enable to Output Enable
35
50
ns
tUOT
Output Toggle Times
Update to Output Reprogram
25
45
ns
tWOT
Write Enable to Output Reprogram
25
45
ns
tUOD*
Output Disable Times
Update to Output Disabled
25
45
ns
tWOD
Write Enable to Output Disabled
25
45
ns
tWHU
Setup Time
Write Enable to Update
0
ns
tUW
Width of Update Pulse
10
ns
*Not shown
CS
RE
INPUT
D[5:0]
A[5:0]
OUTPUTS
ADDR 1
ADDR 2
{ADDR 1}
DATA
DATA {ADDR 2}
tAA
tRDE
tCSR
tRHA
tCHR
tRDD
Figure 4b. Second Rank Readback Cycle
Table VIII. Second Rank Readback Cycle
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
tCSR
Setup Time
Chip Select to Read Enable
TA = 25 C0
ns
tCHR
Hold Time
Chip Select from Read Enable
VCC = 3.3 V
0
ns
tRHA
Address from Read Enable
5
ns
tRDE
Enable Time
Data from Read Enable
15
ns
tAA
Access Time
Data from Address
15
30
ns
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PDF描述
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