VDD = 2.7 V to 5.25 V,, " />
參數(shù)資料
型號(hào)： AD7171BCPZ-REEL7
廠商： Analog Devices Inc
文件頁數(shù)： 12/16頁
文件大小： 0K
描述： IC ADC 16BIT SER 125HZ 10LFCSP
標(biāo)準(zhǔn)包裝： 1,500
位數(shù)： 16
采樣率（每秒）： 125
數(shù)據(jù)接口： 串行，SPI?
轉(zhuǎn)換器數(shù)目： 1
電壓電源： 單電源
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 10-WFDFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 10-LFCSP-WD（3x3）
包裝： 帶卷 (TR)
輸入數(shù)目和類型： 1 個(gè)差分，雙極
Data Sheet
AD7171
Rev. A | Page 5 of 16
TIMING CHARACTERISTICS
VDD = 2.7 V to 5.25 V,, GND = 0 V, Input Logic 0 = 0 V, Input Logic 1 = VDD, unless otherwise noted.
Table 2.
Parameter1, 2
Limit at TMIN, TMAX
Unit
Conditions/Comments
READ
t1
100
ns min
SCLK high pulse width
t2
100
ns min
SCLK low pulse width
0
ns min
SCLK active edge to data valid delay4
60
ns max
VDD = 4.75 V to 5.25 V
80
ns max
VDD = 2.7 V to 3.6 V
t4
10
ns min
SCLK inactive edge to DOUT/RDY high
RESET
t5
100
ns min
PDRST low pulse width
t6
25
ms typ
PDRST high to data valid delay
1 Sample tested during initial release to ensure compliance. All input signals are specified with tR = tF = 5 ns (10% to 90% of VDD) and timed from a voltage level of 1.6 V.
3 These numbers are measured with the load circuit shown in Figure 2 and defined as the time required for the output to cross the VOL or VOH limits.
4 SCLK active edge is the falling edge of SCLK.
ISINK (1.6mA WITH VDD = 5V,
100A WITH VDD = 3V)
ISOURCE (200A WITH VDD = 5V,
100A WITH VDD = 3V)
1.6V
TO
OUTPUT
PIN
50pF
08
41
7-
00
2
Figure 2. Load Circuit for Timing Characterization
TIMING DIAGRAMS
t3
t1
t2
t4
DOUT/RDY (O)
SCLK (I)
I = INPUT, O = OUTPUT
MSB
LSB
08
41
7-
0
03
Figure 3. Read Cycle Timing Diagram
t5
t6
PDRST (I)
DOUT/RDY (O)
I = INPUT, O = OUTPUT
08
41
7-
0
04
Figure 4. Resetting the AD7171
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PDF描述
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參數(shù)描述
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AD7172-2BRUZ-RL 功能描述:24 Bit Analog to Digital Converter 2, 4 Input 1 Sigma-Delta 24-TSSOP 制造商:analog devices inc. 系列:- 包裝:帶卷（TR） 零件狀態(tài):有效 位數(shù):24 采樣率（每秒）:31.25k 輸入數(shù):2，4 輸入類型:差分，單端 數(shù)據(jù)接口:SPI，DSP 配置:MUX-ADC 無線電 - S/H:ADC:- A/D 轉(zhuǎn)換器數(shù):1 架構(gòu):三角積分 參考類型:外部， 內(nèi)部 電壓 - 電源，模擬:2 V ~ 5.5 V 電壓 - 電源，數(shù)字:2 V ~ 5.5 V 特性:- 工作溫度:-40°C ~ 105°C 封裝/外殼:24-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商器件封裝:24-TSSOP 標(biāo)準(zhǔn)包裝:2,500
AD7172-2BRUZ-RL7 功能描述:24 Bit Analog to Digital Converter 2, 4 Input 1 Sigma-Delta 24-TSSOP 制造商:analog devices inc. 系列:- 包裝:帶卷（TR） 零件狀態(tài):有效 位數(shù):24 采樣率（每秒）:31.25k 輸入數(shù):2，4 輸入類型:差分，單端 數(shù)據(jù)接口:SPI，DSP 配置:MUX-ADC 無線電 - S/H:ADC:- A/D 轉(zhuǎn)換器數(shù):1 架構(gòu):三角積分 參考類型:外部， 內(nèi)部 電壓 - 電源，模擬:2 V ~ 5.5 V 電壓 - 電源，數(shù)字:2 V ~ 5.5 V 特性:- 工作溫度:-40°C ~ 105°C 封裝/外殼:24-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商器件封裝:24-TSSOP 標(biāo)準(zhǔn)包裝:1,000
AD7172-4BCPZ 功能描述:24 Bit Analog to Digital Converter 4, 8 Input 1 Sigma-Delta 32-LFCSP-WQ (5x5) 制造商:analog devices inc. 系列:- 包裝:托盤 零件狀態(tài):有效 位數(shù):24 采樣率（每秒）:31.25k 輸入數(shù):4，8 輸入類型:差分，單端 數(shù)據(jù)接口:SPI，DSP 配置:MUX-ADC 無線電 - S/H:ADC:- A/D 轉(zhuǎn)換器數(shù):1 架構(gòu):三角積分 參考類型:外部， 內(nèi)部 電壓 - 電源，模擬:2 V ~ 5.5 V 電壓 - 電源，數(shù)字:2 V ~ 5.5 V 特性:- 工作溫度:-40°C ~ 105°C 封裝/外殼:32-WFQFN 裸露焊盤，CSP 供應(yīng)商器件封裝:32-LFCSP-WQ（5x5） 標(biāo)準(zhǔn)包裝:1
AD7172-4BCPZ-RL 功能描述:24 Bit Analog to Digital Converter 4, 8 Input 1 Sigma-Delta 32-LFCSP-WQ (5x5) 制造商:analog devices inc. 系列:- 包裝:帶卷（TR） 零件狀態(tài):有效 位數(shù):24 采樣率（每秒）:31.25k 輸入數(shù):4，8 輸入類型:差分，單端 數(shù)據(jù)接口:SPI，DSP 配置:MUX-ADC 無線電 - S/H:ADC:- A/D 轉(zhuǎn)換器數(shù):1 架構(gòu):三角積分 參考類型:外部， 內(nèi)部 電壓 - 電源，模擬:2 V ~ 5.5 V 電壓 - 電源，數(shù)字:2 V ~ 5.5 V 特性:- 工作溫度:-40°C ~ 105°C 封裝/外殼:32-WFQFN 裸露焊盤，CSP 供應(yīng)商器件封裝:32-LFCSP-WQ（5x5） 標(biāo)準(zhǔn)包裝:5,000
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