參數(shù)資料
型號(hào)： AD5062BRJZ-2REEL7
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 3/20頁(yè)
文件大小： 0K
描述： IC DAC 16BIT 2.7-5.5V SOT23-8
產(chǎn)品培訓(xùn)模塊： Data Converter Fundamentals
DAC Architectures
標(biāo)準(zhǔn)包裝： 3,000
系列： nanoDAC™
設(shè)置時(shí)間： 4µs
位數(shù)： 16
數(shù)據(jù)接口： DSP，MICROWIRE?，QSPI?，串行，SPI?
轉(zhuǎn)換器數(shù)目： 1
電壓電源： 單電源
功率耗散（最大）： 3.5mW
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： SOT-23-8
供應(yīng)商設(shè)備封裝： SOT-23-8
包裝： 帶卷 (TR)
輸出數(shù)目和類型： 1 電壓，單極；1 電壓，雙極
采樣率（每秒）： 1.3M
AD5062
Rev. A | Page 11 of 20
–40
–20
0
20
40
60
80
100
120
140
TEMPERATURE (
°C)
04766-010
–0.010
–0.008
–0.006
–0.004
–0.002
0
0.002
0.004
0.006
0.008
0.010
GAIN
E
RROR
(%fs
r)
GAIN ERROR @ VDD = 5.5V
GAIN ERROR @ VDD = 2.7V
VDD = 5.5V VREF = 4.096V
VDD = 2.7V VREF = 2.0V
Figure 22. Gain Error vs. Temperature
04766-081
0.45
0.46
0.47
0.48
0.49
0.50
0.51
0.52
0
16
14
12
10
8
6
4
2
MORE
FRE
Q
UE
NCY
BIN
Figure 23. IDD Histogram @ VDD = 3 V
04766-082
0.60
0.61
0.62
0.63
0.64
0.65
0
16
14
12
10
8
6
4
2
MORE
FRE
Q
UE
NCY
BIN
Figure 24. IDD Histogram @ VDD = 5 V
04766-025
CH1 2V/DIV CH2 1V/DIV TIME BASE = 100
μs
VDD = 5V VREF = 4.096VDD
RAMP RATE = 200
μs
TA = 25°C
CH1 = VDD
CH2 = VOUT
Figure 25. Hardware Power-Down Glitch
04766-026
CH1 2V/DIV CH2 2V/DIV CH3 20mV/DIV CH4 2V/DIV
TIME BASE 1
μs/DIV
CH3 = VOUT
CH4 = TRIGGER
CH2 = SYNC
CH1 = SCLK
VDD = 5V VREF = 4.096VDD
TA = 25°C
Figure 26. Exiting Software Power-Down Glitch
04766-083
1.5
2.0
2.5
3.0
3.5
4.0
–1.2
–1.0
–0.8
–0.6
–0.4
–0.2
0
0.2
0.4
0.6
0.8
1.0
1.2
4.5
INL
E
RROR
(LS
B
)
REFERENCE VOLTAGE (V)
TA = 25°C
VDD = 5.5V
MIN INL @ VDD = 5.5V
MAX INL @ VDD = 5.5V
Figure 27. INL vs. VREF @ VDD = 5.5 V
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PDF描述
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