ADDR + 1 ADDR + 2 Byte 12 Byte 13 Byte 14 Byte 15 Byte" />
參數(shù)資料
型號： AD1954YSTZRL
廠商： Analog Devices Inc
文件頁數(shù)： 18/36頁
文件大小： 0K
描述： IC DAC AUDIO 3CHAN 26BIT 48LQFP
產(chǎn)品培訓(xùn)模塊： Data Converter Fundamentals
DAC Architectures
標(biāo)準(zhǔn)包裝： 2,000
系列： SigmaDSP®
位數(shù)： 26
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 3
電壓電源： 模擬和數(shù)字
功率耗散（最大）： 510mW
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 帶卷 (TR)
輸出數(shù)目和類型： 6 電壓，單極
采樣率（每秒）： 48k
AD1954
–25–
Byte 7
Byte 12
Byte 8
Byte 13
Byte 9
Byte 14
Byte 10
Byte 15
Byte 11
Byte 16
ADDR + 1 ADDR + 2
Byte 12
Byte 13
Byte 14
Byte 15
Byte 16
Table XI. Program RAM Read/Write Format (Burst Address)
Byte 0
Byte 1
Byte 2
Byte 3
Byte 4
Byte 5
Byte 6
00000, R/W
00000, R/
00000, R/ , Addr[9:8] Addr[7:0] 00000, Prog[34:32] Prog[31:24] Prog[23:16]
Prog[15:8] Prog[7:0]
Table XII. SPI Control Register 1 Write Format
Byte 0
Byte 1
Byte 2
Byte 3
00000, R/W
00000, R/
00000, R/ , Addr[9:8]
Addr[7:0]
0000, Bit[11:8]
Bit[7:0]
Table XIII. SPI Control Register 1 Read Format
Byte 0
Byte 1
Byte 2
00000, R/W
00000, R/
00000, R/ , Addr[9:8]
Addr[7:0]
000000, Bit[1:0]
Table XIV. SPI Control Register 2 Write Format
Byte 0
Byte 1
Byte 2
Byte 3
00000, R/W
00000, R/
00000, R/ , Addr[9:8]
Addr[7:0]
000000, Bit[9:8]
Bit[7:0]
Table XV. SPI Volume Register Write Format
Byte 0
Byte 1
Byte 2
Byte 3
Byte 4
000000, Addr[9:8]
Addr[7:0]
00,Volume[21:16]
Volume[15:8]
Volume[7:0]
Table XVI. Data Capture Register Write Format
Byte 0
Byte 1
Byte 2
Byte 3
00000, R/W
00000, R/
00000, R/ , Addr[9:8]
Addr[7:0]
00000, ProgCount[8:6]1
ProgCount[5:0], RegSel[1:0]1, 2
NOTES
1ProgCount[8:0] = value of program counter where trap occurs (see Table XX).
2RegSel[1:0] selects one of four registers (see Data Capture Register section).
Table XVII. Data Capture Serial Out Register (Address and Register Select) Write Format
Byte 0
Byte 1
Byte 2
Byte 3
00000, R/W
00000, R/
00000, R/ , Addr[9:8]
Addr[7:0]
00000, ProgCount[8:6]1
ProgCount[5:0], RegSel[1:0]1, 2
NOTES
1ProgCount[8:0] = value of program counter where trap occurs (see Table XX).
2RegSel[1:0] selects one of four registers (see Data Capture Register section).
Table XVIII. Data Capture Read Format
Byte 0
Byte 1
Byte 2
Byte 3
Byte 4
Byte 5
00000, R/W
00000, R/
00000, R/ , Addr[9:8]
Addr[7:0]
00000000
Data[23:16]
Data[15:8]
Data[7:0]
Table XIX. Safeload Register Write Format
Byte 0
Byte 1
Byte 2
Byte 3
Byte 4
Byte 5
00000, R/W
00000, R/
00000, R/ , Addr[9:8]
Addr[7:0]
ParamAddr[7:0]
00, Param[21:16]
Param[15:8]
Param[7:0]
ADDR
REV. A
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PDF描述
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