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參數(shù)資料
| 型號(hào)： | A3PN125-VQG100I |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
| 封裝： | 14 X 14 MM, 1.20 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, VQFP-100 |
| 文件頁(yè)數(shù)： | 71/106頁(yè) |
| 文件大小： | 3324K |
| 代理商： | A3PN125-VQG100I |
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ProASIC3 nano Flash FPGAs
R e visio n 8
2 - 53
Global Resource Characteristics
A3PN250 Clock Tree Topology
Clock delays are device-specific. Figure 2-23 is an example of a global tree used for clock routing. The
global tree presented in Figure 2-23 is driven by a CCC located on the west side of the A3PN250 device.
It is used to drive all D-flip-flops in the device.
Figure 2-23 Example of Global Tree Use in an A3PN250 Device for Clock Routing
Central
Global Rib
VersaTile
Rows
Global Spine
CCC
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A3PN125-VQG100 | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
| A3PN125-Z1VQ100I | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
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| A3PN125-Z1VQG100 | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| A3PN125-Z2VQ100 | 功能描述:IC FPGA NANO 125K GATES 100-VQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:ProASIC3 nano 標(biāo)準(zhǔn)包裝:152 系列:IGLOO PLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):792 RAM 位總計(jì):- 輸入/輸出數(shù):120 門數(shù):30000 電源電壓:1.14 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA，CSBGA 供應(yīng)商設(shè)備封裝:289-CSP（14x14） |
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