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參數(shù)資料
| 型號： | A14100A-1RQ208I |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 18/90頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 10K GATES 208-PQFP |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | ACT™ 3 |
| LAB/CLB數(shù)： | 1377 |
| 輸入/輸出數(shù)： | 175 |
| 門數(shù)： | 10000 |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 208-BFQFP 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 208-RQFP（28x28） |
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Accelerator Series FPGAs – ACT 3 Family
R e visio n 3
2 - 17
Figure 2-11 Output Buffers
Figure 2-12 AC Test Loads
Figure 2-13 Input Buffer Delays
To AC test loads (shown below)
PAD
D
E
TRIBUFF
In
VCC
GND
50%
Out
VOL
VOH
1.5 V
tDHS,
50%
1.5 V
tDHS
En
VCC
GND
50%
Out
VOL
1.5 V
tENZHS,
50%
10%
tENHSZ
En
VCC
GND
50%
Out
GND
VOH
1.5 V
tENZHS,
50%
90%
tENHSZ
VCC
Load 1
(Used to measure propagation delay)
Load 2
(Used to measure rising/falling edges)
35 pF
To the output under test
VCC
GND
35 pF
To the output under test
R to VCCfor t
PLZ / tPZL
R to GND for t
PHZ / tPZH
R = 1 k
Ω
PAD
Y
INBUF
In
3V
0V
1.5 V
Out
GND
VCC
50%
tINY
1.5 V
50%
tINY
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ASC49DREI-S734 | CONN EDGECARD 98POS .100 EYELET |
| RBB106DHBT-S621 | EDGECARD 212POS DIP R/A .050 SLD |
| ASC50DRTF-S13 | CONN EDGECARD 100POS .100 EXTEND |
| AMC50DRTF-S13 | CONN EDGECARD 100POS .100 EXTEND |
| ASC50DREF-S13 | CONN EDGECARD 100POS .100 EXTEND |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| A14100A-2BG313C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| A14100A-2BG313I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| A14100A-2PG257C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| A14100A-2RQ208C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| A14100A-2RQ208I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
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