參數(shù)資料
型號: 9DB1233AGLF
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 時鐘及定時
英文描述: 9DB SERIES, PLL BASED CLOCK DRIVER, 12 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO64
封裝: 6.10 MM, 0.50 MM PITCH, ROHS COMPLIANT, MO-153, TSSOP-64
文件頁數(shù): 8/15頁
文件大?。?/td> 181K
代理商: 9DB1233AGLF
IDT Twelve Output Differential Buffer for PCIe Gen3
9DB1233
Twelve Output Differential Buffer for PCIe Gen3
2
1675B—11/08/10
Pin Configuration
VDD 1
64 VDDA
DIF_IN 2
63 AGND
DIF_IN# 3
62 IREF
GND 4
61 VDD
OE0# 5
60 OE11#
DIF_0 6
59 DIF_11
DIF_0# 7
58 DIF_11#
VDD 8
57 VDD
GND 9
56 GND
OE1# 10
55 OE10#
DIF_1 11
54 DIF_10
DIF_1# 12
53 DIF_10#
OE2# 13
52 OE9#
DIF_2 14
51 DIF_9
DIF_2# 15
50 DIF_9#
GND 16
49 GND
VDD 17
48 VDD
OE3# 18
47 OE8#
DIF_3 19
46 DIF_8
DIF_3# 20
45 DIF_8#
OE4# 21
44 OE7#
DIF_4 22
43 DIF_7
DIF_4# 23
42 DIF_7#
VDD 24
41 VDD
GND 25
40 GND
OE5# 26
39 OE6#
DIF_5 27
38 DIF_6
DIF_5# 28
37 DIF_6#
**ADR_SEL 29
36 VTTPWRGD#/PD
HIGH_BW# 30
35 BYPASS#/PLL
VDD 31
34 GND
SMBCLK 32
33 SMBDAT
64-TSSOP
** Indicates 120K ohm Pulldown
9
D
B
1
2
3
Power Groups
VDD
GND
1
4
DIF_IN/DIF_IN#
8, 17, 24, 41,
48, 57
9, 16, 25, 40,
49, 56
DIF(11:0)
N/A
63
IREF
64
63
Analog VDD & GND
for PLL core
Note: Please treat pin 1 as an analog VDD.
Description
Pin Number
SMBus Address Selection (Pin 29)
ADR_SEL
Voltage
SMBus Adr (Wr/Rd)
Low
<0.8V
DC/DD
Mid
1.2<Vin<1.8V
D6/D7
High
Vin > 2.0V
D4/D5
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PDF描述
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參數(shù)描述
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