參數(shù)資料
型號(hào)： 932S422CGLF-T
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時(shí)鐘產(chǎn)生/分配
英文描述： 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
封裝： 6.10 MM, 0.50 MM PITCH, LEAD FREE, MO-153, TSSOP-56
文件頁(yè)數(shù)： 3/21頁(yè)
文件大?。?/td> 193K
代理商： 932S422CGLF-T
11
Integrated
Circuit
Systems, Inc.
ICS932S422C
1412A—12/10/07
SMBus Table: SRC Output Enable Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
SRCCLK7 Enable
Output Enable
RW
Disable-Hi-Z
Enable
1
Bit 6
SRCCLK6 Enable
Output Enable
RW
Disable-Hi-Z
Enable
1
Bit 5
SRCCLK5 Enable
Output Enable
RW
Disable-Hi-Z
Enable
1
Bit 4
SRCCLK4 Enable
Output Enable
RW
Disable-Hi-Z
Enable
1
Bit 3
SRCCLK3 Enable
Output Enable
RW
Disable-Hi-Z
Enable
1
Bit 2
SRCCLK2 Enable
Output Enable
RW
Disable-Hi-Z
Enable
1
Bit 1
SRCCLK1 Enable
Output Enable
RW
Disable-Hi-Z
Enable
1
Bit 0
CPUCLK4
Output Enable
RW
Disable-Hi-Z
Enable
1
SMBus Table: CPU, REF and 48 MHz Output Enable Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
REF1 Enable
Output Enable
RW
Disable-Low
Enable
1
Bit 6
REF0 Enable
Output Enable
RW
Disable-Low
Enable
1
Bit 5
CPUCLK3
Output Enable
RW
Disable-Hi-Z
Enable
1
Bit 4
CPUCLK2
Output Enable
RW
Disable-Hi-Z
Enable
1
Bit 3
0
Bit 2
CPUCLK1
Output Enable
RW
Disable-Hi-Z
Enable
1
Bit 1
CPUCLK0
Output Enable
RW
Disable-Hi-Z
Enable
1
Bit 0
Spread Spectrum
Enable
Spread Off/On
RW
Spread Off
Spread On
0
SMBus Table: PCI and PCICLK_F Output Enable Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
PCICLK3
Output Enable
RW
Disable-Low
Enable
1
Bit 6
PCICLK2
Output Enable
RW
Disable-Low
Enable
1
Bit 5
PCICLK1
Output Enable
RW
Disable-Low
Enable
1
Bit 4
PCICLK0
Output Enable
RW
Disable-Low
Enable
1
Bit 3
PCICLK_F2 Enable
Output Enable
RW
Disable-Low
Enable
1
Bit 2
PCICLK_F1 Enable
Output Enable
RW
Disable-Low
Enable
1
Bit 1
PCICLK_F0 Enable
Output Enable
RW
Disable-Low
Enable
1
Bit 0
48MHz Enable
Output Enable
RW
Disable-Low
Enable
1
SMBus Table: PCICLK_F and SRC Stop Control Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
PCICLK_F2 Stop En
RW
Free-Running
Stoppable
1
Bit 6
PCICLK_F1 Stop En
RW
Free-Running
Stoppable
1
Bit 5
PCICLK_F0 Stop En
RW
Free-Running
Stoppable
1
Bit 4
SRCCLK4 Stop En
RW
Free-Running
Stoppable
1
Bit 3
SRCCLK3 Stop En
RW
Free-Running
Stoppable
1
Bit 2
SRCCLK2 Stop En
RW
Free-Running
Stoppable
1
Bit 1
SRCCLK1 Stop En
RW
Free-Running
Stoppable
1
Bit 0
0
RESERVED
Free-Running Control,
Default: not affected by
PCI/SRC_STOP
(Byte 4, bit 5)
26,27
9
-
23,24
10
23,24
21,22
Byte 3
21,22
18,19
Byte 0
NA
26,27
NA
39,40
18,19
54
9
4
10
42,43
6
5
45,46
32,31
Byte 1
55
36,37
CPU, SRC, PCI
Byte 2
-
11
13
3
11
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PDF描述
932S422CFLF-T 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
932S431AGLFT 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
932S431AGLF 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
932S825YGLFT 220 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO64
932S825YGT 220 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO64
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參數(shù)描述
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