參數(shù)資料
型號(hào)： 89C55
廠商： Atmel Corp.
英文描述： 8-Bit Microcontroller with 20K Bytes Flash
中文描述： 8位閃存微控制器20,000字節(jié)
文件頁(yè)數(shù)： 19/24頁(yè)
文件大?。?/td> 606K
代理商： 89C55
AT89C55
4-187
AC Characteristics
Under operating conditions, load capacitance for Port 0, ALE/PROG, and PSEN = 100 pF; load capacitance for all other
outputs = 80 pF.
External Program and Data Memory Characteristics
Symbol
Parameter
Variable Oscillator
Units
Min
Max
1/t
CLCL
Oscillator Frequency
0
33
MHz
t
LHLL
ALE Pulse Width
2t
CLCL
- 40
ns
t
AVLL
Address Valid to ALE Low
t
CLCL
- 13
ns
t
LLAX
Address Hold After ALE Low
t
CLCL
- 20
ns
t
LLIV
ALE Low to Valid Instruction In
4t
CLCL
- 65
ns
t
LLPL
ALE Low to PSEN Low
t
CLCL
- 13
ns
t
PLPH
PSEN Pulse Width
3t
CLCL
- 20
ns
t
PLIV
PSEN Low to Valid Instruction In
3t
CLCL
- 45
ns
t
PXIX
Input Instruction Hold After PSEN
0
ns
t
PXIZ
Input Instruction Float After PSEN
t
CLCL
- 10
ns
t
PXAV
PSEN to Address Valid
t
CLCL
- 8
ns
t
AVIV
Address to Valid Instruction In
5t
CLCL
- 55
ns
t
PLAZ
PSEN Low to Address Float
10
ns
t
RLRH
RD Pulse Width
6t
CLCL
- 100
ns
t
WLWH
WR Pulse Width
6t
CLCL
- 100
ns
t
RLDV
RD Low to Valid Data In
5t
CLCL
- 90
ns
t
RHDX
Data Hold After RD
0
ns
t
RHDZ
Data Float After RD
2t
CLCL
- 28
ns
t
LLDV
ALE Low to Valid Data In
8t
CLCL
- 150
ns
t
AVDV
Address to Valid Data In
9t
CLCL
- 165
ns
t
LLWL
ALE Low to RD or WR Low
3t
CLCL
- 50
3t
CLCL
+ 50
ns
t
AVWL
Address to RD or WR Low
4t
CLCL
- 75
ns
t
QVWX
Data Valid to WR Transition
t
CLCL
- 20
ns
t
QVWH
Data Valid to WR High
7t
CLCL
- 120
ns
t
WHQX
Data Hold After WR
t
CLCL
- 20
ns
t
RLAZ
RD Low to Address Float
0
ns
t
WHLH
RD or WR High to ALE High
t
CLCL
- 20
t
CLCL
+ 25
ns
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PDF描述
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