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參數(shù)資料
| 型號(hào)： | 82860 |
| 英文描述： | Controller Miscellaneous - Datasheet Reference |
| 中文描述： | 控制器雜項(xiàng)-數(shù)據(jù)表參考 |
| 文件頁數(shù)： | 82/211頁 |
| 文件大小： | 1099K |
| 代理商： | 82860 |
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Register Description
R
82
Intel
82860 MCH Datasheet
Bit
Description
6
SERR on Hub Interface_A Target Abort (TAHLA).
1 = MCH detected that an MCH originated Hub Interface_A cycle was terminated with a Target
Abort completion packet or special cycle.
0 = Software must write a 1 to clear this bit.
5
MCH Detects Unimplemented Hub Interface_A Special Cycle (HIAUSC).
1 =
MCH detected an Unimplemented Special Cycle on the Hub Interface_A.
0 = Software must write a 1 to clear this bit.
4
AGP Access Outside of Graphics Aperture Flag (OOGF).
1 = An AGP access occurred to an address that is outside of the graphics aperture range.
0 = Software must write a 1 to clear this bit.
3
Invalid AGP Access Flag (IAAF).
1 = An AGP access was attempted outside of the graphics aperture and either to the
640 KB–1 MB range or above the TOM.
0 = Software must write a 1 to clear this bit.
2
Invalid Graphics Aperture Translation Table Entry (ITTEF).
1 = An invalid translation table entry was returned in response to an AGP access to the graphics
aperture.
0 = Software must write a 1 to clear this bit.
1
Multiple-bit DRAM ECC Error Flag (DMERR).
1 = A memory read data transfer had an uncorrectable multiple-bit error. When this bit is set, the
address, channel number, and device number that caused the error are logged in the EAP
register. Once this bit is set, the EAP, CN, DN, and ES fields are locked until the processor
clears this bit by writing a 1. Software uses bits [1:0] to detect whether the logged error
address is for single- or multiple-bit error.
0 = Once software completes the error processing, a value of 1 is written to this bit field to clear
the value (back to 0) and unlock the error logging mechanism.
0
Single-bit DRAM ECC Error Flag (DSERR).
1 = A memory read data transfer had a single-bit correctable error and the corrected data was
sent for the access. When this bit is set, the address, channel number, and device number
that caused the error are logged in the EAP register. Once this bit is set, the EAP, CN, DN,
and ES fields are locked to further single-bit error updates until the processor clears this bit
by writing a 1. A multiple-bit error that occurs after this bit is set will overwrite the EAP, CN,
and DN fields with the multiple-bit error signature and the MEF bit will also be set.
0 = Software must write a 1 to clear this bit and unlock the error logging mechanism.
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PDF描述 |
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