參數(shù)資料
型號： 74LVC823A
廠商： NXP Semiconductors N.V.
英文描述： 9-bit D-type flip-flop with 5-volt tolerant inputs/outputs;positive-edge trigger(3-State)(帶5V輸入/輸出容限的上升沿觸發(fā)的9位D觸發(fā)器（三態(tài)）)
中文描述： 9位D型觸發(fā)器5伏容限輸入/輸出;積極邊緣觸發(fā)（3態(tài)）（帶5V的輸入/輸出容限的上升沿觸發(fā)的9位?觸發(fā)器（三態(tài)））
文件頁數(shù)： 8/12頁
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代理商： 74LVC823A
Philips Semiconductors
Product specification
74LVC823A
9-bit D-type flip-flop with 5-volt tolerant
inputs/outputs; positive-edge trigger (3-State)
1998 Sep 24
8
AC WAVEFORMS
V
M
= 1.5V at V
CC
V
and V
OH
are the typical output voltage drop that occur with the
output load.
V
X
= V
OL
+ 0.3V at V
CC
2.7V; V
X
= V
OL
+ 0.1 V
CC
at V
CC
V
Y
= V
OH
–0.3V at V
CC
2.7V; V
Y
= V
OH
– 0.1 V
CC
at V
CC
2.7V; V
M
= 0.5 V
CC
at V
CC
2.7V.
2.7V
2.7V
GND
VOL
VI
VOH
VM
CP INPUT
QnOUTPUT
VM
tPLH
tPHL
1/fmax
tW
SA00423
Figure 1. Clock (CP) to output (Q
n
) propagation delays, the
clock pulse width and the maximum clock pulse frequency.
outputs
disabled
outputs
enabled
outputs
enabled
tPHZ
tPZH
tPZL
tPLZ
VX
VY
VM
VM
VM
OE INPUT
VCC
VI
VOL
VOH
GND
GND
OUTPUT
LOW–to–OFF
OFF–to–LOW
OUTPUT
HIGH–to–OFF
OFF–to–HIGH
SA00424
Figure 2. 3-State enable and disable times.
ééééééééééé
ééééééééééé
Dn,
INPUT
QnOUTPUT
VM
th
tsu
th
tsu
VM
CP INPUT
GND
GND
VOL
VI
VI
VOH
SA00425
NOTE:
The shaded areas indicate when the input is permitted to change
for predictable output performance.
CE
Figure 3. Data setup and hold times for the D
n
input and CE
input to the CP input.
SA00519
t
PHL
t
rem
Q
n
OUTPUT
MR INPUT
CP INPUT
t
w
Figure 4. Master reset pulse width, master reset to clock
removal time, master reset to output propagation delay.
TEST CIRCUIT
PULSE
GENERATOR
V
I
R
T
D.U.T.
V
O
C
L
50pF
S
1
2 x V
CC
Open
GND
500
500
V
CC
V
I
2.7V
V
CC
2.7V
2.7V – 3.6V
Test
S
1
GND
t
PLZ
/t
PZL
t
PHZ
/t
PZH
2 x V
CC
t
PLH
/t
PHL
Open
SY00003
V
CC
Figure 5. Load circuitry for switching times.
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PDF描述
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74LVC823ABQ-Q100J 功能描述:74LVC823ABQ-Q100/SOT815/DHVQFN 制造商:nexperia usa inc. 系列:* 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:3,000
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