參數(shù)資料
型號(hào)： 74HCT74
廠商： NXP Semiconductors N.V.
英文描述： Dual D-TYPE flip-flop with set and reset;positive-edge trigger(帶指令集和復(fù)位的雙D觸發(fā)器；上升沿觸發(fā))
中文描述： 雙D型觸發(fā)器設(shè)置和復(fù)位觸發(fā)器，積極邊緣觸發(fā)器（帶指令集和復(fù)位的雙?觸發(fā)器;上升沿觸發(fā)）
文件頁(yè)數(shù)： 6/13頁(yè)
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代理商： 74HCT74
1998 Feb 23
6
Philips Semiconductors
Product specification
Dual D-type flip-flop with set and reset;
positive-edge trigger
74HC/HCT74
DC CHARACTERISTICS FOR 74HCT
For the DC characteristics see
“74HC/HCT/HCU/HCMOS Logic Family Specifications”
.
Output capability: standard
I
CC
category: flip-flops
Note to HCT types
The value of additional quiescent supply current (
I
CC
) for a unit load of 1 is given in the family specifications.
To determine
I
CC
per input, multiply this value by the unit load coefficient shown in the table below.
AC CHARACTERISTICS FOR 74HCT
GND = 0 V; t
r
= t
f
= 6 ns; C
L
= 50 pF
INPUT
UNIT LOAD COEFFICIENT
nD
nR
D
nS
D
nCP
0.70
0.70
0.80
0.80
SYMBOL
PARAMETER
T
amb
(
°
C)
UNIT
TEST CONDITIONS
74HCT
V
CC
(V)
WAVEFORMS
+
25
40 to
+
85
40 to
+
125
min.
typ.
max.
min.
max.
min.
max.
t
PHL
/ t
PLH
propagation delay
nCP to nQ, nQ
propagation delay
nS
D
to nQ, nQ
propagation delay
nR
D
to nQ, nQ
output transition time
18
35
44
53
ns
4.5
Fig.6
t
PHL
/ t
PLH
23
40
50
60
ns
4.5
Fig.7
t
PHL
/ t
PLH
24
40
50
60
ns
4.5
Fig.7
t
THL
/ t
TLH
7
15
19
22
ns
4.5
Fig.6
t
W
clock pulse width
HIGH or LOW
set or reset pulse width
LOW
removal time
set or reset
set-up time
nD to nCP
hold time
nCP to nD
maximum clock pulse
frequency
18
9
23
27
ns
4.5
Fig.6
t
W
16
9
20
24
ns
4.5
Fig.7
t
rem
6
1
8
9
ns
4.5
Fig.7
t
su
12
5
15
18
ns
4.5
Fig.6
t
h
3
3
3
3
ns
4.5
Fig.6
f
max
27
54
22
18
MHz
4.5
Fig.6
相關(guān)PDF資料
PDF描述
74HCT85D-T Magnitude Comparator
74HCT86D-T Quad 2-input Exclusive OR (XOR) Gate
74HC85D-T Magnitude Comparator
74HC86D-T Quad 2-input Exclusive OR (XOR) Gate
74HCT9015 Nine wide Schmitt trigger buffer/line driver
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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74HCT7403D-Q100,518 制造商:NXP Semiconductors 功能描述:
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