參數(shù)資料
型號： 74HCT112
廠商： NXP Semiconductors N.V.
英文描述： 8-Line To 3-Line Priority Encoders 16-SO -40 to 85
中文描述： 雙JK觸發(fā)器設置和復位觸發(fā)器，負邊沿觸發(fā)
文件頁數(shù)： 9/15頁
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代理商： 74HCT112
1998 Jun 10
9
Philips Semiconductors
Product specification
Dual JK flip-flop with set and reset;
negative-edge trigger
74HC/HCT112
AC WAVEFORMS
Fig.6
Waveforms showing the clock (nCP) to output (nQ, nQ) propagation delays, the clock pulse width,
the nJ, nK to nCP set-up times, the nCP to nJ, nK hold times, the output transition times and the maximum
clock pulse frequency.
The shaded areas indicate when the input is permitted to
change for predictable output performance.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
handbook, full pagewidth
MBK218
VM
(1)
nCP INPUT
nSD INPUT
nRD INPUT
nQ OUTPUT
nQ OUTPUT
VM
(1)
VM
(1)
VM
(1)
VM
(1)
tW
trem
trem
tW
tPHL
tPLH
tPLH
tPHL
Fig.7
Waveforms showing the set (nS
D
) and reset (nR
D
) input to output (nQ, nQ) propagation delays, the set
and reset pulse width and the nR
D
and nS
D
to nCP removal time.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
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PDF描述
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相關代理商/技術參數(shù)
參數(shù)描述
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