參數(shù)資料
型號： 74ALVC74
廠商： NXP Semiconductors N.V.
英文描述： Dual D-type flip-flop with set and reset; positive-edge trigger
中文描述： 帶設(shè)置和復(fù)位功能的雙D觸發(fā)器；上升沿觸發(fā)
文件頁數(shù)： 8/20頁
文件大?。?/td> 103K
代理商： 74ALVC74
2003 May 26
8
Philips Semiconductors
Product specification
Dual D-type flip-flop with set and reset;
positive-edge trigger
74ALVC74
AC CHARACTERISTICS
SYMBOL
PARAMETER
TEST CONDITIONS
MIN.
TYP.
(1)
MAX.
UNIT
OTHER
V
CC
(V)
T
amb
=
40 to +85
°
C
t
PHL
/t
PLH
propagation delay
nCP to nQ, nQ
see Figs 6 and 8
1.65 to 1.95
2.3 to 2.7
2.7
3.0 to 3.6
1.65 to 1.95
2.3 to 2.7
2.7
3.0 to 3.6
1.65 to 1.95
2.3 to 2.7
2.7
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2.3 to 2.7
2.7
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2.3 to 2.7
2.7
3.0 to 3.6
1.65 to 1.95
2.3 to 2.7
2.7
3.0 to 3.6
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2.3 to 2.7
2.7
3.0 to 3.6
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
2.5
2.5
2.5
2.5
2.5
2.5
2.5
2.5
0.7
0.7
0.7
0.7
1.2
1.2
0.9
0.8
0.6
0.6
0.7
0.8
3.7
2.6
2.8
2.7
3.4
2.4
3.2
2.3
3.5
2.5
3.1
2.3
0.9
0.6
1.3
1.3
0.9
0.9
1.0
0.7
0.2
0.1
0.1
0.1
0.6
0.8
0.5
0.4
0.4
0.3
0.4
0.1
6.2
4.2
4.2
3.8
5.4
3.8
4.2
3.5
5.4
3.8
4.3
3.5
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
t
PHL
/t
PLH
propagation delay
nSD to nQ, nQ
see Figs 7 and 8
t
PHL
/t
PLH
propagation delay
nRD to nQ, nQ
see Figs 7 and 8
t
W
clock pulse width
HIGH or LOW
see Figs 6 and 8
t
W
set or reset pulse width LOW see Figs 7 and 8
t
rem
removal time set or reset
see Figs 7 and 8
t
su
set-up time nD to nCP
see Figs 6 and 8
t
h
hold time nD to nCP
see Figs 6 and 8
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PDF描述
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