參數(shù)資料
型號： 71256T36-6
廠商： Cypress Semiconductor Corp.
英文描述： 256K x 18 Synchronous-Pipelined Cache Tag RAM
中文描述： 256 × 18的同步高速緩存標(biāo)記內(nèi)存流水線
文件頁數(shù)： 21/24頁
文件大小： 244K
代理商： 71256T36-6
CY7C1359A/GVT71256T18
Document #: 38-05120 Rev. **
Page 21 of 24
Read/Write Timing without Burst Feature
[32, 34, 35]
Notes:
34. In this timing diagram, it is assumed that burst feature is not used and therefore ADSP is tied to HIGH (V
CC
) and ADSC is tied to LOW (V
SS
). The logic state
of ADV is a
“
Don
’
t Care
”
.
35. In this timing diagram, it is assumed that WE = [BWE + WEL*WEH]*GW.
Switching Waveforms
(continued)
CLK
ADDRESS
WE#
CE#
DEN#
OE#
DQ
A1
A2
A4
Q(A1)
Q(A2)
t
S
t
H
t
KC
A5
D(A5)
D(A6)
Reads
A8
A3
A6
A7
Q(A3)
Q(A4)
D(A7)
D(A8)
t
KH
t
KL
t
KQ
t
KQX
t
OEHZ
t
OEQ
t
OELZ
t
KQLZ
t
KQHZ
Writes
相關(guān)PDF資料
PDF描述
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