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參數(shù)資料
| 型號： | 64F3672FX |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | Hitachi Single-Chip Microcomputer |
| 中文描述： | 日立單片機(jī) |
| 文件頁數(shù)： | 54/323頁 |
| 文件大小： | 1596K |
| 代理商： | 64F3672FX |
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Rev. 2.0, 03/02, page 30 of 298
Table 2.12 Effective Address Calculation (1)
No
1
r
op
31
0
23
2
3
Register indirect with displacement
@(d:16,ERn) or @(d:24,ERn)
4
r
op
disp
r
op
rm
op
rn
31
0
0
r
op
23
0
31
0
disp
31
0
31
0
23
0
23
0
Addressing Mode and Instruction Format
Effective Address Calculation
Effective Address (EA)
Register direct(Rn)
General register contents
General register contents
General register contents
General register contents
Sign extension
Register indirect(@ERn)
Register indirect with post-increment or
pre-decrement
Register indirect with post-increment @ERn+
Register indirect with pre-decrement @-ERn
1, 2, or 4
1, 2, or 4
Operand is general register contents.
The value to be added or subtracted is 1 when the
operand is byte size, 2 for word size, and 4 for
longword size.
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